找回密码
 注册

QQ登录

只需一步,快速开始

扫一扫,访问微社区

巢课
电巢直播8月计划
查看: 1943|回复: 3
打印 上一主题 下一主题

求教:关于串联终端匹配和并联终端匹配

[复制链接]

2

主题

10

帖子

-8980

积分

未知游客(0)

积分
-8980
跳转到指定楼层
1#
发表于 2010-3-21 01:25 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您!

您需要 登录 才可以下载或查看,没有帐号?注册

x
求教高手讲解:串联终端匹配和并联终端匹配是怎么会是,并且应用的场合?
分享到:  QQ好友和群QQ好友和群 QQ空间QQ空间 腾讯微博腾讯微博 腾讯朋友腾讯朋友 微信微信
收藏收藏1 支持!支持! 反对!反对!

21

主题

91

帖子

674

积分

三级会员(30)

Rank: 3Rank: 3Rank: 3

积分
674
2#
发表于 2010-3-22 14:04 | 只看该作者
它们的主要目的都是为了减少反射。
$ ~! M) j- s+ b5 U' e0 j7 y9 v串行端接是通过在尽量靠近源端的位置串行插入一个电阻RS(典型10Ω到75Ω)到传输线中来实现的。串
% U- f1 z9 ~6 }/ _( Z  R3 C- K$ J行端接是为了匹配信号源的阻抗,所插入的串行电阻阻值加上驱动源的输出阻抗应大于等于传输线阻抗(轻微过阻尼)。) h" G8 J0 T4 W, C# D8 R9 l: k& @
并行端接主要是在尽量靠近负载端的位置加上拉和/或下拉阻抗以实现终端的阻抗匹配,根据不同的应用环境,并行端接又可分为以下几种类型:/ F7 h8 J) H! _) }. s
1简单的并行端接
/ g) F8 q' Q' G7 r7 O) p7 T3 P2戴维宁(Thevenin)并行端接9 ]! a1 b( D) |7 q- x
3 主动并行端接4 n9 c9 Q- i: U, \
4并行AC端接
) G; {  H- j, V6 z& A( @5 二极管并行端接(肖特基二极管端接)
5 X* R8 b; }1 o: z. e3 Z5 Y一般来说" W  f! C( R5 `% l4 |+ \/ ~- u* ^
对于一个CMOS工艺的驱动源,其输出阻抗值较稳定且接近传输线的阻抗值,因此对于CMOS器件使用串行) I  h7 x# ]* H8 G' J; V9 m
端接技术就会获得较好的效果。  y# s8 k$ X) r! G) L# V$ A( U
TTL工艺的驱动源在输出逻辑高电平和低电平时其输出阻抗有所不同,这时,使用并行戴维宁端接方案则是一种较好的策略。! [; Z! Y9 e. v1 k5 |1 y2 w
ECL器件一般都具有很低的输出阻抗,因此,在ECL电路的接收端使用一下拉端接电阻(下拉电平需要根- X* P7 b6 D3 u/ e
据实际情况选取)来吸收能量则是ECL电路的通用端接技术。

2

主题

16

帖子

-8908

积分

未知游客(0)

积分
-8908
3#
发表于 2010-3-25 15:39 | 只看该作者
本帖最后由 playdad 于 2010-3-25 15:41 编辑 1 R% @& T1 u2 ?$ D! D

0 z" l8 o$ m, k+ @5 Y+ C- M1.串联匹配时驱动电流较并联匹配小,因此EMI效果好;2.串联匹配时线路RC常数大,因此会增大边沿时间。在有多个receiver时,并联匹配使用多一些,比如电脑主板的ddr匹配。

1

主题

26

帖子

521

积分

三级会员(30)

Rank: 3Rank: 3Rank: 3

积分
521
4#
发表于 2010-3-29 14:41 | 只看该作者
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

巢课

技术风云榜

关于我们|手机版|EDA365 ( 粤ICP备18020198号 )

GMT+8, 2024-12-23 13:01 , Processed in 0.058931 second(s), 32 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表