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刚学allegro,问几个比较低能的问题.....以后连载

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发表于 2009-7-29 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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小弟刚学Allegro,用的是Allegro16.0,但有非常重要的任务在身,就是要用Allegro画一个6或8层的手机板。让我学习的时间太短太短了。现在还没入门,可能需要问些比较低能也是比较典型的问题,也希望我的学习经历能给后面学习的哥哥姐姐弟弟妹妹有所帮助.先向即将帮助与支持我的同志表示诚挚的谢意 !& s8 a, b# B9 S4 B
1.哪位兄弟姐妹有没有供学习的手机板子,最好有  原理图+PCB,用Allegro画的。
  q& }7 ?  C/ g# @" C, X  c2.手机板子叠层如何设计最好,以6及8层板为例。并告知每层的厚度及每层该走什么信号线比较好。4 B8 q4 i/ @+ G, E7 v( j9 B
3.今天学习Allegro遇到的几个问题:: {3 L1 p1 `) b3 R. ~* e
   封装Non-standard drill这的几个选项:Laser,Plasma,Punch,Other都表示什么意思,什么情况需要用到?如图:
' t) ]6 |4 x- f  B7 l1 _& ^
9 \( {1 X! E( G. S4 `2.很多地方看到写了 Allegro/APD, 不知道后面的APD是什么软件,是不是Allegro Package Designer?  W6 ?- ^* y1 O, b0 F0 p7 L
  这个软件从字面上理解应该是做封装的,难道 是画板子的?如果是画板子的,跟Allegro有啥不一样啊?. |4 Z, g; s: {+ E' Z' c6 }1 t2 i
3.今天在看一个别人画的板子,Show Element一个BGA时,显示这么个东西:
1 S6 @9 E/ M6 `" M; ]- [    LISTING: 1 element(s)
  `8 e$ M7 n2 v8 P% h
5 y$ c7 P, O& x" q. V; q( @       < COMPONENT INSTANCE >      
0 L" j, [0 D+ `# D& V" D2 d$ i6 M- v$ p+ B. w
  Reference Designator: U72 n" l6 a5 Q5 ]7 {6 x
  Package Symbol:       PBGA400
4 g9 ~, x- R/ r2 |7 @7 N- n5 t) A9 ~% o
8 ?4 x7 K2 k& v/ Z3 b/ h  Component Class:      DISCRETE
1 j( Z/ l3 A$ ^: }  Device Type:          KSZ8692P_43_PBGA400_KSZ9692PB' N( T/ r, w- M5 ~
    Value:              KSZ9692PB
* d% \9 p- A" R5 ?* z' f" `9 k. V
  m4 U  i" E% Z+ x0 g( c  Placement Status:     PLACED
! K, m" I6 J" S    origin-xy:    (5150.000 4512.500)
8 \& I& r5 `: W/ P8 z2 L; D8 Y* F# M    rotation:  0.000  degrees/ l# n6 w; k' y# T% E# i) V' s0 ]
    not_mirrored2 f- R( r0 i8 C: c
& d+ V- b5 K; C! t6 r' j) I3 C
  Function(s):
2 c; v2 V$ {: S8 w; S    Designator: F118 f& j0 G. Q# M$ y/ r- `+ Q# ?
    Type:       TYPE4$ a3 ^! e$ ]) N' R. d+ J* }, _2 ~
    Pin(s):     C10, E10, A7, A6, A8...
+ ]* m2 j; z" l# i% S* y/ r% t3 \. a3 |  F& Q' I
    Designator: F10
' @6 ^9 u. W- S: M  ~4 V    Type:       TYPE3
+ ?6 d, x/ L( z5 k, A4 @( C4 F    Pin(s):     V16, Y18, T16, U17, V18...
2 I5 }- s' {- g/ D! w, b) q+ K; }7 V7 F
    Designator: F9$ E8 r2 j' X' |8 f9 h9 f
    Type:       TYPE25 M' B' ]9 a/ s6 z6 `
    Pin(s):     H10, H11, H7, H8, H9...& f0 ]" w  k2 C6 h  A; A

5 Q" h+ ~4 n6 h! P    Designator: F8& |* i$ G; y* H
    Type:       TYPE1
/ u* V+ D3 x# M, e3 W9 Y    Pin(s):     H19, H18, H17, P20, M17...
& B5 A) F; Q7 w5 @
9 S7 [. R5 ]' {9 D0 E6 k: Z% ^) {  Properties attached to component instance
% h8 `9 F' \4 M2 \- U0 F9 L    SIGNAL_MODEL      = KSZ8692P_43_PBGA400_KSZ9692PB_KSZ9692PB) U; p4 x  X: ^+ b) k% N

% F5 o% w4 R0 u# |  Properties attached to component definition
1 D  ~! t/ ]4 T! f- G    VALUE             = KSZ9692PB
. u/ g$ t; l; M: {- A; W# [  y8 r; _: y9 `- d" I3 I* W) u
请问这个Function(S)和SIGNAL_MODEL是指的什么属性?
* @7 t8 Z3 s8 I先就这么多了。希望哪位兄弟能尽快帮我解决一下。
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 楼主| 发表于 2009-7-29 18:57 | 只看该作者
问题继续:
1 I8 B4 Y4 h/ m; j7 }2 [9 e我看了两个别人画的多层板子,在设置过孔时在Solder Mask _Bottom都设置了阻焊参数。这有啥用啊?! o" O. W1 E7 u- D4 v2 I- D! N% h
如附件:) |  `3 ]% E0 S! T3 |5 V6 p

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发表于 2009-7-30 17:36 | 只看该作者
楼主 你的 Allegro16.0  的软件能给我共享下不! 我到处找下的, 有好多不能用  ,, 我以前都是用 PROTEL 话PCB图的, 现在要用到BGA 的器件,想用这个软件,
1 o1 v: [4 j0 x8 }  传个给我好吗!  @ 谢谢啊!@  
% c# k8 R0 |; T9 a' q) y) G: N
- [' O& \* s: F+ J+ `* i  H我邮箱598201378@qq.com,  加我QQ也行, 非常感谢!!!

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 楼主| 发表于 2009-7-30 19:00 | 只看该作者
有5个CD,共2.05G,发不了呀!你到网上找个地方下下吧,应该挺好找的...

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发表于 2009-7-30 19:38 | 只看该作者
2# caiyongsheng 9 I+ E" P4 l* u( u. e
; w6 b- d5 r3 b$ w1 u, h

' a4 w7 W, R$ Z/ ]开防焊是不是为了用此via做测试点啊?

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发表于 2009-7-30 19:41 | 只看该作者
建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下/ @  M& S+ h# a* W& s: a! T- O
论坛里有比较好的教程的

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发表于 2009-7-30 20:35 | 只看该作者
真佩服你们公司领导,不知道是他们胆量大,还是在为难你,哎。。。。- `9 b( U+ T1 S+ x9 b
只能说:你多加油吧,多加班吧!!!
MENTOR奋斗中!!!!
GOOD GOOD STUDY,DAY DAY UP

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 楼主| 发表于 2009-7-31 08:41 | 只看该作者
foxconnwj开防焊是不是为了用此via做测试点啊?
* [+ I( N+ j( C( @4 s. ^5 D, B0 |0 K* d) `6 S
5楼的,还没看过别人用过孔做测试点呢,过孔露铜在外面,还真没见过...0 ]. ?" h, a2 ?8 f1 W% O1 T5 a( i5 ~
前天听一位前辈说加了mask就是直通的孔,如果不加呢,PCB生产厂商就会在孔中间加些材料堵住过孔,哎,也不知道是不是这样理解啊,望高人再指点一下...

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 楼主| 发表于 2009-7-31 08:49 | 只看该作者
6#
- I2 j* |+ g" G1 X. I& ^6 ]: z) l
  p4 X* T$ m) A$ A1 r2 h建议先拿本书系统地走一下过程吧,然后遇到问题再具体搜索或者问别人一下
% f1 r  ]. N( Q! N" j# I; M4 X论坛里有比较好的教程的.  J5 L0 j+ N9 H! `* x- N7 ^

! p- i3 t' B; l+ t5 @# q6 U这个我当然知道了,我手上有两本教材,就是因为在教材上及网上找不到相关的资料才发上来的。

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发表于 2009-7-31 11:38 | 只看该作者
本帖最后由 biglin 于 2009-7-31 11:39 编辑 ; D0 |8 V1 J5 l& ~+ K

3 K: @8 r* z0 s' {+ R7 Q0 P. g8# caiyongsheng 0 F1 w+ p3 g7 s# _/ C1 ~' K

2 {( v6 Z' M- t( C過孔當測點早已行之多年..5樓兄弟的說法是正確的..

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 楼主| 发表于 2009-8-24 09:36 | 只看该作者
贴子快沉一个月了。
7 Y7 k; ]' R: D$ NNo_probe_top(禁止探針探入區域):关于这个subclass我看到别人画封装时画了这么个区域,请问这个区域是做什么用的??
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