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请问Pads导出的EMN file是那个层别的限高信息,起形状是怎样生成的?

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发表于 2017-5-4 11:19 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如题,请问怎样将EMN file导出的零件实体在PADS中怎样查看,例如以前使用的为Allegro,EMN file导出的为Place bound的形状  B8 R* n" F$ \% x; Z& c0 ?! U

( h* [4 r8 @, I5 _9 }% s7 r! f2 m
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发表于 2017-5-9 09:06 | 只看该作者
hwz2824262 发表于 2017-5-6 08:39. x  E) b+ R+ {4 W0 E
谢谢,我再研究一下吧,我不懂PROE,所以每次都得找结构。

2 R3 R' r: |$ G哈哈,我也是把结构给找烦了,人家丢给我一个Proe的安装包,然后我自己反复建库输出尝试。
我不懂音乐,所以时而不靠谱,时而不着调。

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发表于 2017-5-5 16:14 | 只看该作者
苏鲁锭 发表于 2017-5-5 22:016 [1 O/ ~) p% R; ?2 {# p7 Y$ Q
so,输出的EMN是不是自己想要的,取决于封装是怎么画的。这可以算是pads的特色或bug吧。
2 ~; j& Q, S' A6 \& W0 K5 a
Pads就是这样的,不算bug,这软件就是这么的傻。
1 u+ v: a- E' z严谨的做法是贵司结构需要按照器件datasheet做一个3D模型,让这个3D与emp中器件的名字相对应,当Pads导出的emp导入ProE后,直接引出这个3D模型,而不是只是用emp中的这个简单的块,Pads导出的器件是没有细节的,需要结构另做。
# O. Q5 a- I( N  C# r7 i( O注意emn是板框,emp是器件。2 H& ?5 B% x) F3 [( T

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一看就是高手!  发表于 2017-5-5 16:28

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发表于 2017-5-4 12:55 | 只看该作者
。。。。。

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大神,能帮忙回答一下嘛?  详情 回复 发表于 2017-5-4 15:20

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 楼主| 发表于 2017-5-4 15:20 | 只看该作者
yangjinxing521 发表于 2017-5-4 12:55
$ W! p8 D5 G% Z4 s  `( w6 v+ Q。。。。。
. @8 y* ]  E! G- x
大神,能帮忙回答一下嘛?3 J) z( M: z+ v4 A9 j% S. i" _

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发表于 2017-5-4 16:28 | 只看该作者
制作封装时,封装Attributes里面添加Geometry.Height,里面手动填写器件高度。如1.2mm,则导出emn时在ProE里器件高度就是1.2mm。

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谢谢!了解怎样添加器件高度,我想知道是器件高度产生的图形是按哪个图层的形状产生?我将板中的零件信息导出EMN给机构,机构用PROE打开时,我发现与我实际板子放置的位置有偏差,所以我想知道是根据哪个层别产生的  详情 回复 发表于 2017-5-4 16:47

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 楼主| 发表于 2017-5-4 16:47 | 只看该作者
scofiled 发表于 2017-5-4 16:289 ?4 Y8 ]2 W+ P5 I4 Z: T2 T
制作封装时,封装Attributes里面添加Geometry.Height,里面手动填写器件高度。如1.2mm,则导出emn时在ProE ...

( ^% I- J  O2 \$ E! E0 @谢谢!了解怎样添加器件高度,我想知道是器件高度产生的图形是按哪个图层的形状产生?我将板中的零件信息导出EMN给机构,机构用PROE打开时,我发现与我实际板子放置的位置有偏差,所以我想知道是根据哪个层别产生的?
: R# T( u( G* F$ ^3 }; k, S

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看你问题问的就说明你之前是用Allegro的。呵呵。Pads没那么智能,高度不是设置在某个层里的,它只是填一个参数即可,而且导出的形状也很粗糙的,永远都是长方体,长宽就是器件的最大外围,即如果用丝印做了极性或1脚  详情 回复 发表于 2017-5-4 17:26

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发表于 2017-5-4 17:26 | 只看该作者
hwz2824262 发表于 2017-5-4 16:47. j2 v3 ?# l1 d$ G& Z( r
谢谢!了解怎样添加器件高度,我想知道是器件高度产生的图形是按哪个图层的形状产生?我将板中的零件信息 ...

* I/ }; i8 f( y' t  x看你问题问的就说明你之前是用Allegro的。呵呵。Pads没那么智能,高度不是设置在某个层里的,它只是填一个参数即可,而且导出的形状也很粗糙的,永远都是长方体,长宽就是器件的最大外围,即如果用丝印做了极性或1脚标识,它导出的长宽就会更大,与实际差异很大的。
8 n$ F$ F$ r6 W

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谢谢你的回复,我发现PADS导出的元件高度信息,不仅仅是变大,而是感觉整个元件都有偏移,我实际看到元件没有偏出板外,而导出的EMN信息却显示已经超出板外,这样的信息让机构很难判断正确,我们的元件是否与结构有  详情 回复 发表于 2017-5-5 19:54

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 楼主| 发表于 2017-5-5 19:54 | 只看该作者
scofiled 发表于 2017-5-4 17:26
! ?+ R' I  p( s' _8 I: n看你问题问的就说明你之前是用Allegro的。呵呵。Pads没那么智能,高度不是设置在某个层里的,它只是填一 ...

+ p8 ^3 j: ]) O# `! a# l谢谢你的回复,我发现PADS导出的元件高度信息,不仅仅是变大,而是感觉整个元件都有偏移,我实际看到元件没有偏出板外,而导出的EMN信息却显示已经超出板外,这样的信息让机构很难判断正确,我们的元件是否与结构有干涉。所以想了解一下导出的信息是怎样产生的4 d  o4 K4 {& n$ T) X

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发表于 2017-5-5 21:56 | 只看该作者
举个最简单的封装例子,见图1。上边的封装是丝印层2D线+焊盘,下边的是Top层2D线+焊盘。4 A  ]( u5 v  E1 v) d  S
它们在PCB图中输出的EMN见图2。1 J8 Q$ _% s5 L: L$ k
它们的差异见图3紫色框所围范围。
. L' V# A4 A6 H& }9 V7 z说明:1.它们的高度同楼上,在attributes里自行填写。
/ {; j& o0 d) @" t- K% D0 k2.丝印层画的那个封装,EMN输出的灰色矩形是依照——2D线和焊盘所占用的最大面积+高度。, f! Q2 s- ?" P3 f, n/ `
3.Top层画的那个封装,EMN输出的灰色矩形是依照——2D线所占用的最大面积+高度。
- x! v7 C! C$ N: U+ p& G
6 ~) i% w' f/ S) B* e# p( O+ J! {0 A+ `$ v& A

PCB差异.png (16.12 KB, 下载次数: 0)

图1

图1

emn差异.png (10.52 KB, 下载次数: 0)

图2

图2

emn差异2.png (12.99 KB, 下载次数: 0)

图3

图3

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大神解释的很清楚,谢谢!但是我遇见了导出的EMN信息跟元件实体相比对,不仅仅是变大,而是整体会向一边偏移。是否是建元件的时候有画在layerXX的层别信息也会影响? 还是元件的坐标原点的问题?  详情 回复 发表于 2017-5-5 16:56
我不懂音乐,所以时而不靠谱,时而不着调。

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发表于 2017-5-5 22:01 | 只看该作者
so,输出的EMN是不是自己想要的,取决于封装是怎么画的。这可以算是pads的特色或bug吧。

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Pads就是这样的,不算bug,这软件就是这么的傻。 严谨的做法是贵司结构需要按照器件datasheet做一个3D模型,让这个3D与emp中器件的名字相对应,当Pads导出的emp导入ProE后,直接引出这个3D模型,而不是只是用emp中  详情 回复 发表于 2017-5-5 16:14
我不懂音乐,所以时而不靠谱,时而不着调。

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 楼主| 发表于 2017-5-5 16:56 | 只看该作者
苏鲁锭 发表于 2017-5-5 21:56# e% D+ V- a! V6 d1 T$ o( O0 n
举个最简单的封装例子,见图1。上边的封装是丝印层2D线+焊盘,下边的是Top层2D线+焊盘。
& X9 i+ W8 V9 J( V4 S: A它们在PCB图中输 ...
& I+ }! F9 h: b! v( d+ A) E- G3 ?1 v
大神解释的很清楚,谢谢!但是我遇见了导出的EMN信息跟元件实体相比对,不仅仅是变大,而是整体会向一边偏移。是否是建元件的时候有画在layerXX的层别信息也会影响?
9 Y% ~5 n/ r# ]1 s9 \6 w! n还是元件的坐标原点的问题?2 c( Y, g& V. m

% V7 r7 o! B4 h# `) m. B

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其他层的内容也有可能影响,你可以在封装中把其他的层内容删掉试试。再就是不论灰色矩形怎么走样,它的宽度是可以量出来的,然后在PCB上对照着找,能找到是谁造成的。  详情 回复 发表于 2017-5-5 18:00

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hwz2824262 发表于 2017-5-5 16:56
, T; e! X6 G# o! S5 V/ T大神解释的很清楚,谢谢!但是我遇见了导出的EMN信息跟元件实体相比对,不仅仅是变大,而是整体会向一边 ...
0 N9 N- P, c8 @# r' I9 I) w
其他层的内容也有可能影响,你可以在封装中把其他的层内容删掉试试。再就是不论灰色矩形怎么走样,它的宽度是可以量出来的,然后在PCB上对照着找,能找到是谁造成的。7 {" G" g0 _3 w  H# }& ~

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谢谢,我再研究一下吧,我不懂PROE,所以每次都得找结构。  详情 回复 发表于 2017-5-6 08:39
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 楼主| 发表于 2017-5-6 08:39 | 只看该作者
苏鲁锭 发表于 2017-5-5 18:00
& a  u1 @) D1 t  d! f/ p其他层的内容也有可能影响,你可以在封装中把其他的层内容删掉试试。再就是不论灰色矩形怎么走样,它的宽 ...
1 W' S7 o. w3 }
谢谢,我再研究一下吧,我不懂PROE,所以每次都得找结构。; q' Q7 G' z: ]1 C7 b5 B

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哈哈,我也是把结构给找烦了,人家丢给我一个Proe的安装包,然后我自己反复建库输出尝试。  详情 回复 发表于 2017-5-9 09:06
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