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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 求助，PCIe链路必须Retrain才能跑到Gen3
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求助，PCIe链路必须Retrain才能跑到Gen3

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gavinhuang

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发表于 2018-7-13 16:15 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我们系统的PCIe链路示意图如下图所示；
' _) P, G: v; e! _1 C5 k* B. F% i; `: J1 J问题：每次开机或者重启后，通过工具可以看到CPU和PEX8724之间的PCIe链路是工作在Gen3的状态，但是PEX8724与下游的PCIe设备之间是工作在Gen1的，通过工具强制让PCIe链路重新训练（retrain）之后，PEX8724与下游的设备之间的链路才能工作在Gen3。3 d2 A# {6 Q/ S2 L: _9 n+ ]
: \1 s% U& T3 W7 K) L4 K# G

3 ?  y4 M; _2 e
4 T5 _" r. i6 |2 f! Y有没有大神可以指导一二，非常感谢！
$ f5 _- ~$ x- D* U: \+ U* Q; l7 i/ {, }+ w8 @0 p5 }6 ~/ {
) ~( ^2 y! ?5 r, P  C' w  B) D" Z& L5 C
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Jujianjun

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发表于 2018-7-16 12:56 | 只看该作者
PCIE的启动顺序是这样的：
. D* w! @' p8 ?% t/ G4 A3 m1. PCIE 的root complex上电后，会先由LTSSM状态机开始检测* Y- {9 H8 ]+ Q: E  G- c' J
2. 分别detect -> polling -> Config -> L0,这时候都是工作在2.5G- o/ c0 j& o. m) E! A
3. 进入L0后， 会进入recovery状态， 协商进入GEN2或者GEN3
0 }8 y+ r* l9 [7 Y1 S4. 具体的状态图附图所示， 这部分比较抽象， 如有不明白的可以call我电话18621873572& w. o! c7 ?& P" I

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