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EDA365电子工程师网»技术社区 › 电子技术社区 › QA检查（免费服务） › 2017年11月5日QA检查报告节选
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2017年11月5日QA检查报告节选

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EDA365QA

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发表于 2017-11-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.匹配电阻应该靠近连接器放置
; n$ ]+ a4 _1 U" p% e
9 z  \" y" @' [! K# F# C
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发表于 2017-11-6 17:44 | 只看该作者
EDA365QA 发表于 2017-11-6 10:16
0 o, ]5 l" u* V4 V6.高速线不哟啊在挖空的隔离焊盘下方走线
# a/ k; U1 k/ F- w+ o: X+ E; s2 l
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
- _* ?; o8 V1 x

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ccccindy
我的理解是不能在挖空区域底下过 这样参考平面不完整 落在分隔区 走线应该完全落在参考平面上  详情 回复 发表于 2017-11-28 15:40
剑铮奇迹
不是器件，是差分过孔反盘，穿反盘导致那块参考不连续，这种情况是可以避免的  详情 回复 发表于 2017-11-7 15:58
EDA365QA
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。  详情 回复 发表于 2017-11-7 09:03
Jamie_he2015
应该是，不要在两个过孔之间的挖空区走线  详情 回复 发表于 2017-11-6 18:54

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发表于 2017-11-28 15:40 | 只看该作者
1023598725 发表于 2017-11-6 17:44
# W" b. z9 ^$ E* u7 S! S你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

" X/ i2 D2 e% j. g  B9 M) V  J6 z* ~我的理解是不能在挖空区域底下过  这样参考平面不完整  落在分隔区  走线应该完全落在参考平面上
6 W$ Y2 T0 P8 F8 G! A2 j$ G, D

2.jpg (69.57 KB, 下载次数: 0)

2.jpg

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1023598725
谢谢  详情 回复 发表于 2017-12-4 08:28

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fengyu6117

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发表于 2017-11-8 09:56 | 只看该作者
EDA365QA 发表于 2017-11-6 10:15
- _" x% ]  q" V4.CAN没有按照差分走线

) ~8 u7 `1 s1 NCAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。& i) A7 X, f$ X; D. M6 g. i
这个家伙很懒，从来不写个人签名。

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 楼主| 发表于 2017-11-6 10:14 | 只看该作者
2.电源没有来源
! H: e) m* [2 m  J * R; ]. _4 \: ^1 X# ~: {1 w

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 楼主| 发表于 2017-11-6 10:15 | 只看该作者
3.网格部分应该是表层禁布
# ]0 E5 J; O$ B# @. O! T
% b$ J; v: _; m9 H( U

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jiangriver
为什么要禁止布线? 没听懂.  详情 回复 发表于 2017-11-7 19:02

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 楼主| 发表于 2017-11-6 10:15 | 只看该作者
4.CAN没有按照差分走线7 D* P1 L+ s$ a" T1 c  k

0 \7 I1 y) v5 W) V* e

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fengyu6117
CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。  详情 回复 发表于 2017-11-8 09:56
LiuTao166462139
can为什么要走查分呢  详情 回复 发表于 2017-11-7 15:49

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 楼主| 发表于 2017-11-6 10:15 | 只看该作者
5.串口电容加粗处理
# t+ x5 I5 q: v6 {9 {1 H3 n: h
6 v# w( P+ M7 t% v' D# T0 v, ]0 {

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 楼主| 发表于 2017-11-6 10:16 | 只看该作者
本帖最后由 EDA365QA 于 2017-11-7 09:02 编辑
3 W- b$ W& U1 f! H! P
- H/ T6 W4 l0 o! x% b$ F, |6.高速线不能在挖空的隔离焊盘下方走线
% E, e& S. z3 Z- y0 H1 @  l) F6 u) m & e4 I) y: S* c& R7 k

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剑铮奇迹
也不能说不能走线，完全可以把高速线neck模式不走4/4.改成3.9/3.5或者3.5/3.9，满足背钻要求，也可以穿的啊  发表于 2017-11-7 15:54
1023598725
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。  详情 回复 发表于 2017-11-6 17:44

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 楼主| 发表于 2017-11-6 10:16 | 只看该作者
7.此电源不需铺平面( V* J+ j8 |; ]1 ?4 g1 [/ f
- g$ o& j2 Q$ |2 R8 w9 |' N

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 楼主| 发表于 2017-11-6 10:16 | 只看该作者
8.开路; c: F5 f( Y8 K, a' P2 J3 \

  d: c6 g4 f$ k( [8 Q+ z& y

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 楼主| 发表于 2017-11-6 10:17 | 只看该作者
9.相邻走线层的走线重叠较多
, S3 p+ [9 s! C
  Q. x; e7 P  g: C( V

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 楼主| 发表于 2017-11-6 10:17 | 只看该作者
10.485没有走差分' W' ^  ^! I$ [! t! X

1 Y+ R- b" f4 V) Z8 [

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Jamie_he2015

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发表于 2017-11-6 18:54 | 只看该作者
1023598725 发表于 2017-11-6 17:44: s$ J9 g3 C, O- A% T6 ^+ c' y$ d
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

( \1 I! o& F  `9 q& ?: c应该是，不要在两个过孔之间的挖空区走线

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谢谢。  详情 回复 发表于 2017-11-7 11:10

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发表于 2017-11-6 20:16 | 只看该作者
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edapcbsyc

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发表于 2017-11-6 21:45 | 只看该作者
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 楼主| 发表于 2017-11-7 09:03 | 只看该作者
1023598725 发表于 2017-11-6 17:44
2 F6 a+ i2 s5 H3 R' t" v0 K你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
& R( Q; F' E7 @2 `
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。
: [( X$ ]- }9 h' ], c+ L

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1023598725
受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:10
1023598725
受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:09

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