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4片DDR3等长请教

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liuchao6102616

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发表于 2018-3-16 11:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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没有做过DDR3的PCB Layout 查了一些资料  请教几个问题：如图  单片分组：数据组1  数据组2   地址命令控制时钟一组  / Z) ]0 q/ u: ~: A& J; r* O3 E) c4 t
问题1： 单片中数据组1和数据组2之间需要误差要控制多少？
2 R* `' I/ g2 y7 C& ~  y: c: |问题2： 地址命令控制时钟组内等长误差控制多少？
, ]/ U9 @9 l: q  }/ h问题3： 地址命令控制时钟组合数据组间等长误差控制多少？, e; j" Z( Q1 V3 g4 W: n
问题4： 每片DDR3之间是否有等长要求？$ g5 N1 Z7 ]; [
望大神们指教  感谢！  / v. x2 g6 ^4 N3 Y1 e) p) E. f3 f5 k
* T3 C3 a% C! v2 ?+ Z

: F: k! B1 X- B/ I. ^. x! r  g* k* ^
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superlish

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版务助理

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发表于 2018-3-16 17:37 | 只看该作者
分组等长即可
七尺寒光凛冽！痛饮热血四方！

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baby_snow11

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发表于 2018-5-18 22:33 | 只看该作者
学习了

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