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[Sigrity分析] 视频教程 | 如何轻松实现DDR接口精准分析而无需处理大型S参数

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发表于 2018-2-2 11:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 Cadence_CPG_Mkt 于 2018-5-17 19:29 编辑 ( H2 N# h4 V7 C( Q6 Y- C
- D) u: W; z% G% K9 R! S/ x% W. L0 J! X

8 G2 ?+ C! i1 U' f& |2 _$ N  N2 D  b
' u# q  k: n" w: ~
了解更多关于 Cadence公司的Allegro Sigrity SI Base (http://goo.gl/L1k5GX) 以及System Serial Link Analysis Option (http://goo.gl/L03MLd)  请访问相应链接。Allegro Sigrity SI Base (http://goo.gl/L1k5GX)以及兼顾电源的信号完整性分析选项(Power-Aware SI Option) (http://goo.gl/8uouKV) 请访问相应链接。
7 g1 l( I' B0 x$ B8 z4 F/ c% x
Sigrity 技术人员一步一步指导您如何使用时域有限差分法(FDTD)仿真器精准评估同步开关噪声(SSN)在系统环境下的影响。
* k- e7 I2 c% c, P# J" P
从一个PCB设计的宽带spice模型直接连接到一个系统的拓扑结构,而不必进行S参数提取。
% g9 E9 V# d  `* ]
这种“FDTD-direct”方法解决了信号完整性工程师在将S参数转化到简化的宽带Spice模型时,对于精准度受到影响的担心。
8 u: J: ~: ~" J6 A: S5 L
1 T8 Y# z( O, H" K' i
视频链接
1 X# Z9 y  L; F- O: G4 shttp://mooc.eda365.com/course/238/tasks
, q2 Y1 Z- B5 q2 Y; z( g+ z+ X6 O. c% f' S
欢迎您的评论!
您可以通过PCB_marketing_China@cadence.com联系我们,非常感谢您的关注以及宝贵意见。

& u. k: G. b4 Z; k

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发表于 2018-2-3 16:55 | 只看该作者
学习学习学习

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发表于 2018-2-5 09:47 | 只看该作者
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发表于 2018-2-5 09:47 | 只看该作者
看不懂哦

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发表于 2018-3-1 09:22 | 只看该作者
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发表于 2018-3-9 21:42 | 只看该作者
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