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EDA365电子工程师网»技术社区 › 电子技术社区 › Allegro&Orcad PCB论坛 › 1932个焊点的FPGA如何扇出 求指教 要多少层
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1932个焊点的FPGA如何扇出 求指教 要多少层

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liuchao6102616

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发表于 2017-12-26 11:00 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1932个焊点的FPGA如何扇出  求指教 要多少层
3 g0 q9 v7 k  e

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GHOST

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发表于 2017-12-26 11:55 | 只看该作者
这个说不准的吧，叠层还得看板厚，板厚不够也叠不出来高层的- s2 ^3 ?9 J$ r
另外还得看多少网络， PIN间布一根线还是2根线也是不同的
5 ~" y, Q: l. w* w6 A估计要到18-20层左右

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liuchao6102616
多谢  详情 回复 发表于 2017-12-26 14:28
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
日飘渺 夜惆怅 醉眼朦胧 真心人赢得天下输了她

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kevin890505

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发表于 2017-12-26 14:12 | 只看该作者
看芯片具体功能引脚分布了，同样封装的BGA，扇出层数差距大大的。有些厂家会针对BGA引脚分布做优化，就可以节约层数，有些很随意就比较蛋疼。

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liuchao6102616
多谢 12层应该差不多  详情 回复 发表于 2017-12-26 14:29

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liuchao6102616

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 楼主| 发表于 2017-12-26 14:28 | 只看该作者
GHOST 发表于 2017-12-26 11:55
9 A+ B1 t, ?! v: |8 l这个说不准的吧，叠层还得看板厚，板厚不够也叠不出来高层的/ J% T( \" I: ?# j) V
另外还得看多少网络， PIN间布一根线还是2根 ...
( _# ~1 S3 x2 ^+ V. B& y
多谢
/ v9 {% h, \$ t

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liuchao6102616

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 楼主| 发表于 2017-12-26 14:29 | 只看该作者
kevin890505 发表于 2017-12-26 14:12
+ v, ~$ q# @2 i& M/ p看芯片具体功能引脚分布了，同样封装的BGA，扇出层数差距大大的。有些厂家会针对BGA引脚分布做优化，就可以 ...

% E/ p8 B. v$ R# F5 w$ f9 v, c. M多谢  12层应该差不多
* n( {3 ]7 a+ \+ K1 s& k9 o

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zyh610710

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发表于 2017-12-26 15:31 | 只看该作者
可以自己预估一下，前两排走表层，3，4排走背面，后面的就用内层去算，单端信号，还是差分信号，看信号的分部来评估板子的层数，至于超板厚不能加板厚就只能叠相邻层

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liuchao6102616
了解了 多谢！  详情 回复 发表于 2017-12-29 16:35

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這侽孓譙悴丶

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发表于 2017-12-26 15:32 | 只看该作者
本帖最后由 這侽孓譙悴丶 于 2017-12-26 15:34 编辑 3 [1 W1 S, |4 z8 p5 m0 C

0 X8 y, Y/ x2 e自己导入后根据网络的分布（如果功能用得多网络自然就多，如果有些功能没用到自然就有些地方有空Pin，有没有空Pin对布线影响很大）以及布局大概散出一下评估就差不多了，前两排可以拉出去，加上FPGA可以换PIN有些网络顺序就不用担心了，然后再看看电源通道，自己大概评估下！

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liuchao6102616
了解了 多谢！  详情 回复 发表于 2017-12-29 16:35

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cjkao

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发表于 2017-12-26 15:59 | 只看该作者
XILINX 有份文件可參考看看: N& h. E- R6 G; {8 j! n
https://www.xilinx.com/support/d ... ce-design-rules.pdf

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liuchao6102616
多谢！  详情 回复 发表于 2017-12-29 16:34

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南林维京

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发表于 2017-12-28 16:06 | 只看该作者
这FPGA应该是1mm的，
7 z. E+ W* T  C, e1 r1.首先最外面2排的pin,可以拉出去打孔
$ F8 F) Q- T3 `7 @0 `' Y! s8 _& p2.通常情况下2个pin之间可以走2根线，你可这样大概走一下，算下多少层能走完，
9 S" f: g& |* |. U$ C# a3.当然你要把电源用到的层也要算进去；; H! z/ X! R, T, B5 }
4.还有就是要考虑，走线是不是顺的，交叉多不多。有没有特别信号等，不过FPGA，是可以做SWAP pin.
1 y2 z) S5 {( X* ?5.同时也要考虑板厚，厚比等' f8 `2 Z% E9 k* N5 j
, F) N% L/ }5 W1 T$ \: B, a" T/ |% k
以上个人意见。

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liuchao6102616
了解了 多谢！  详情 回复 发表于 2017-12-29 16:34

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liuchao6102616

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 楼主| 发表于 2017-12-29 16:34 | 只看该作者
南林维京 发表于 2017-12-28 16:06
' R4 L+ H2 }! I' \4 t$ T这FPGA应该是1mm的，
2 s, i% T+ s2 y' x, D1.首先最外面2排的pin,可以拉出去打孔
) X/ T% E, r' Q; c- S' h2.通常情况下2个pin之间可以走2根线，你可这 ...

/ F6 [/ D9 j' r+ B* b' z2 x了解了  多谢！
. I: D) m% D9 ^7 p% N& r

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liuchao6102616

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 楼主| 发表于 2017-12-29 16:34 | 只看该作者
cjkao 发表于 2017-12-26 15:59
) u4 }9 B0 ~7 D* jXILINX 有份文件可參考看看
/ X* |- b: I' k9 e$ a* \1 Shttps://www.xilinx.com/support/documentation/user_guides/ug1099-bga-devic ...

# B: P( N' _! o+ p多谢！, j" ?* c- g- ?1 l9 x

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liuchao6102616

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 楼主| 发表于 2017-12-29 16:35 | 只看该作者
這侽孓譙悴丶 发表于 2017-12-26 15:32
  P# O+ Y% {7 K8 N5 `自己导入后根据网络的分布（如果功能用得多网络自然就多，如果有些功能没用到自然就有些地方有空Pin，有没 ...
- g- u  ?4 n" V- \  i
了解了  多谢！
$ P& u6 _  \8 T9 x

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liuchao6102616

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 楼主| 发表于 2017-12-29 16:35 | 只看该作者
zyh610710 发表于 2017-12-26 15:31
/ S$ \( q. N9 }: n" E可以自己预估一下，前两排走表层，3，4排走背面，后面的就用内层去算，单端信号，还是差分信号，看信号的分 ...

+ ?( M' l' @) z- J4 M' M% {了解了  多谢！. m6 }# T+ Q! ^! ?- j

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