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I2C的Data是在时钟上升沿采样还是下降沿采样?

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发表于 2016-8-24 17:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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I2C在SCL高电平期间,SDA电平不能发生变化,在SCL低电平期间,SDA电平可以发生变化。
' [, ^3 Q# ]0 t( L# d那么问题来了,I2C的Data是在SCL的上升沿采样锁存传输还是在SCL的高电平期间传输?# p0 q, r$ s0 T
从I2C的建立时间和保持时间来看,应该是上升沿采样锁存。
0 g- X2 T7 y+ C0 K各位大侠请给点答案啊
& V1 e1 _* Q$ ~+ T7 k

1.jpg (75.08 KB, 下载次数: 2)

I2C时序图

I2C时序图
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发表于 2016-8-29 09:07 | 只看该作者
数据在建立时间后 保持时间前采样

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正解  发表于 2016-8-31 11:06

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发表于 2016-8-24 18:13 | 只看该作者
你这不是自问自答吗。

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我不确定啊,所以征求各位大侠答案  详情 回复 发表于 2016-8-24 18:28

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 楼主| 发表于 2016-8-24 18:28 | 只看该作者
kobeismygod 发表于 2016-8-24 18:13
. N/ X) E0 z3 @3 R0 |# G) g* b你这不是自问自答吗。

$ N  g& l, j0 M1 i我不确定啊,所以征求各位大侠答案4 k* w2 R5 n" R

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发表于 2016-8-24 22:39 | 只看该作者
I2C通常应该在时钟的高电平而不是上升沿或者下降沿读取数据,IC抽样判决的时候只要求在时钟上升沿阶段SDA要能够稳定的保持一段时间。

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I2C要求SDA在SCL为高电平不能跳变,是因为SCL为高电平时,会触发I2C的起始条件和停止条件。  详情 回复 发表于 2016-8-25 12:06
那请问数据的建立时间和保持时间是怎么回事?为什么I2C的SDA建立时间是在SCL的上升沿计算?  详情 回复 发表于 2016-8-25 12:05

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 楼主| 发表于 2016-8-25 12:05 | 只看该作者
故城往事 发表于 2016-8-24 22:396 z  ~$ }8 u" p
I2C通常应该在时钟的高电平而不是上升沿或者下降沿读取数据,IC抽样判决的时候只要求在时钟上升沿阶段SDA要 ...

- y/ A( v) n% B& ~7 p0 w那请问数据的建立时间和保持时间是怎么回事?为什么I2C的SDA建立时间是在SCL的上升沿计算?
; o9 ]7 N; ~" ?/ c

点评

建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。保持时间是指触发器的时钟信号上升沿到来以后,数据也必须保持一段时间,数据保持不变以便能够稳定读取。 采样是在SCL高电平时采样,所以在数据  详情 回复 发表于 2016-9-9 16:41

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 楼主| 发表于 2016-8-25 12:06 | 只看该作者
故城往事 发表于 2016-8-24 22:39
/ m/ M$ [( i5 m/ {I2C通常应该在时钟的高电平而不是上升沿或者下降沿读取数据,IC抽样判决的时候只要求在时钟上升沿阶段SDA要 ...
* X5 E. V* U5 H8 ^
I2C要求SDA在SCL为高电平不能跳变,是因为SCL为高电平时,会触发I2C的起始条件和停止条件。
5 G0 o5 i7 y5 ?6 ]3 V* H7 r

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发表于 2016-9-9 16:41 | 只看该作者
chenlinfeng88 发表于 2016-8-25 12:05
2 h  a$ T$ a7 D( v/ E$ @9 f那请问数据的建立时间和保持时间是怎么回事?为什么I2C的SDA建立时间是在SCL的上升沿计算?

$ T- O: Y+ w5 Z0 X& y& P- M3 y4 e建立时间是指触发器的时钟信号上升沿到来以前,数据稳定不变的时间。保持时间是指触发器的时钟信号上升沿到来以后,数据也必须保持一段时间,数据保持不变以便能够稳定读取。
' P% y) S0 H# O/ o2 x采样是在SCL高电平时采样,所以在数据转换之后到上升沿(10%)这段时间就为建立时间。
8 U; F" g8 c8 w6 w/ E  {# y但是I2C的保持时间好像和以往的定义不同,是在SCL下降沿之后到数据变换之前的时间,这点不是很好理解。
& ?0 W& }3 n% q' Y6 S! {) H; ~: w  {! T& M/ b9 N; u) O
6 ]0 U4 `4 e0 `

+ X6 a4 i" \$ l4 f2 X
$ u8 R2 \) }6 M9 E: H- p6 K/ K6 ]3 j/ }& F# m: l" L

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发表于 2016-9-9 23:18 | 只看该作者
SCL高电平之后采样,而不是边沿采样

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有文献可以考证吗?  详情 回复 发表于 2016-9-10 22:37

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 楼主| 发表于 2016-9-10 22:37 | 只看该作者
xhy_hard 发表于 2016-9-9 23:18
: K2 c* [) y- @* mSCL高电平之后采样,而不是边沿采样

3 }: L! g2 E! d/ I有文献可以考证吗?
4 l- Z5 P7 k% m" x. A

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发表于 2016-10-25 13:34 | 只看该作者
SCL的上升沿采样锁存

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发表于 2018-3-9 21:11 | 只看该作者
本帖最后由 xyh 于 2018-3-9 21:12 编辑
; l2 t' Y. A& |1 X: U* i/ M1 M" D9 B3 L; d9 V3 \
无意中翻到这个帖子,没有人回答清楚,其实I2C的采样也是边沿采样,只不过是上下沿都采一次,这样做的目的是为了检测起始和终止信号,I2C规定:SCL线为高电平期间,SDA线由高电平向低电平的变化表示起始信号;SCL线为高电平期间,SDA线由低电平向高电平的变化表示终止信号。  
8 ]( [" U! o, C' i6 w因此,必须保证在每个时钟周期内对数据线SDA采样两次。对照楼主贴上去那张图,大家应该都能够理解。

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