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2017年8月24日公益PCB评审报告节选

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发表于 2017-8-25 08:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  参考层不一致.; D( n1 A+ v1 X: M) p
' N4 R7 l( e( n3 I$ S
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 楼主| 发表于 2017-8-25 08:32 | 只看该作者
4.  网口中心抽头加粗,还有一根黄色的没接通开路.' \6 |% g6 c5 C
, b* o6 E1 P9 h* j2 A

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 楼主| 发表于 2017-8-25 08:36 | 只看该作者
10.  天线隔层参考下有走线,参考面不完整.( ^3 K6 p' N* V. l

2 F* A! D, |9 X9 k. I0 S4 d

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发表于 2017-8-28 08:37 | 只看该作者
6688hyc 发表于 2017-8-26 09:03
6 W% m  W" h8 F. f$ ]顺便问一下 clock匹配为什么要在末端?
. D  N$ o+ N8 L  {* U
为了不产生反射.* K1 Y# |2 G# `8 [9 F

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 楼主| 发表于 2017-8-25 08:31 | 只看该作者
2.  电容处尽量加VIA.7 I: n% X% X) e
5 _6 z" `8 i1 Z9 a0 @

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 楼主| 发表于 2017-8-25 08:32 | 只看该作者
3.  电源VIA没用上.
" J/ r: v, d; c0 v+ v
1 t: A. Z4 L: J4 O* ]

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 楼主| 发表于 2017-8-25 08:33 | 只看该作者
5.  有线跨分割.
6 |5 M# B6 V! Y$ L1 Y. m
! f2 J: n0 T% `7 y, p4 E

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 楼主| 发表于 2017-8-25 08:33 | 只看该作者
6.  器件没钢网.
+ K1 S8 u4 O( Z! }8 a
) r* b4 f+ q' ~0 y. ^& h$ I

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 楼主| 发表于 2017-8-25 08:34 | 只看该作者
7.  电源要加粗.
: A# g1 H% l3 @5 Z/ i7 C
8 n1 G& Z" C3 c8 F' Y, G* I. V

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 楼主| 发表于 2017-8-25 08:34 | 只看该作者
8.  模拟线加粗.7 c9 m" f1 g. [/ |6 T6 T
* H$ O6 `/ ~% B8 ^- P# ]' \

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 楼主| 发表于 2017-8-25 08:35 | 只看该作者
9.  CLK匹配应在末端,差分要多耦合.
' g; p: S  q0 M
2 J. E% D- M9 C4 w0 |

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发表于 2017-8-25 08:56 | 只看该作者
支持,感谢分享

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发表于 2017-8-25 09:16 | 只看该作者

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发表于 2017-8-25 16:28 | 只看该作者
很棒
' u- p1 G/ c: Y0 j. U

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发表于 2017-8-26 09:02 | 只看该作者
给力 我的哥

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发表于 2017-8-26 09:03 | 只看该作者
顺便问一下 clock匹配为什么要在末端?

点评

pcb
为了不产生反射.  详情 回复 发表于 2017-8-28 08:37
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