PADS logic怎么导出网表，导入到allego画板

blyxz · 发表于 2017-7-19 16:30

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各位大大：求教

～～～PADS logic怎么导出网表，像AD里面的protel、telesis网表一样经过转换就能导到allegro下画PCB？？？

linxiwell · 发表于 2017-7-19 21:27

用EDA_BOMHelper可以读取Logic的原理图然后生成telesis网表。

blyxz · 发表于 2017-7-20 17:26

linxiwell 发表于 2017-7-19 21:27 B% a) F* d& O+ U! b/ S- G" v
用EDA_BOMHelper可以读取Logic的原理图然后生成telesis网表。

论坛上的EDA_BOMHelper都被屏蔽了！！？阁下能发我一份么

linxiwell · 发表于 2017-7-20 19:43

blyxz 发表于 2017-7-20 17:26# T, n# J1 v# f4 P* S6 q
论坛上的EDA_BOMHelper都被屏蔽了！！？阁下能发我一份么

不是不发而是发了你也用不了。是要注册的。抱歉啊！

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