2017年7月18日公益PCB评审报告节选

EDA365QA · 发表于 2017-7-19 08:29

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1. bottom面有一个线头.

EDA365QA · 发表于 2017-7-19 08:32

5. DDR时钟的末端匹配，不应该放在始端.

wshna0221 · 发表于 2017-7-21 16:27

EDA365QA 发表于 2017-7-19 08:32
5 j: Y# W' q0 ~" k4. 网口连线应该从变压器到防护器件再接入芯片,否则没有防护作用.

很多器件布局都受PCB空间制约啊

攻城拔寨 · 发表于 2017-7-19 17:57

EDA365QA 发表于 2017-7-19 08:32
+ l% C% k7 Z% G9 I7 K8 ~4. 网口连线应该从变压器到防护器件再接入芯片,否则没有防护作用.

防护器件不是要靠近端子吗？

EDA365QA · 发表于 2017-7-19 08:30

2. VIA没有作用.

EDA365QA · 发表于 2017-7-19 08:30

3. 布线有尖角.

EDA365QA · 发表于 2017-7-19 08:32

4. 网口连线应该从变压器到防护器件再接入芯片,否则没有防护作用.

EDA365QA · 发表于 2017-7-19 08:33

6. 信号进入挖空区.

EDA365QA · 发表于 2017-7-19 08:33

7. 75V与-48V的距离要加大.

EDA365QA · 发表于 2017-7-19 08:34

8. 电源输入要加粗.

EDA365QA · 发表于 2017-7-19 08:35

9. 差分没有耦合.

EDA365QA · 发表于 2017-7-19 08:35

10. SATA电源铺铜处理.

qilinwang66 · 发表于 2017-7-19 13:36

cjdsn · 发表于 2017-7-19 14:09

学习了点赞

攻城拔寨 · 发表于 2017-7-19 17:59

EDA365QA 发表于 2017-7-19 08:34
: V- W0 S ]) x, C, y2 ]8. 电源输入要加粗.

这个问题经常看到，一般加到多宽

pcb · 发表于 2017-7-20 09:19

攻城拔寨发表于 2017-7-19 17:59$ x2 b9 g& J+ u$ x$ a
这个问题经常看到，一般加到多宽

一般20MIL以上.

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