温补晶振削峰正弦波输出怎么转换？

hao2012 · 发表于 2017-2-28 09:58

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请教熟悉晶振的大侠，在选一种温补晶振FPGA 用，但是看到大部分输出格式都是削峰正弦波的，CMOS 的很少而且几乎都没货，想请都如果是削峰输出的要怎样才能转为FPGA可以直接用的？50M 左右的频率，谢谢~

超級狗 · 发表于 2017-3-4 17:05

hao2012 发表于 2017-3-4 15:50
* r# K" N$ O5 _2 b9 B$ _狗大，看了那个TI的clk buffer CDC3RL02，里面没有明确说两路输出没有相位差啊？这种结构的buffer都是同 ...

是喔～你一開始也只問「温补晶振削峰正弦波输出怎么转换」。

無相位差只是供應商宣傳的手法啦！通常低於 ns 級以下（ps 級）的相位差，就會被宣稱為無相位差。

我不知道樓主想做什麼應用，乾脆給你幾本寶典自已選好了！

超級狗 · 发表于 2017-3-1 11:40

hao2012 发表于 2017-3-1 09:13
9 `- b b* Y8 X* [: i' Z谢谢版主回答这么仔细。狗大还有一个问题：这些用反相器的电路不知道能不能引入误差啊？晶振本来稳定度很 ...

CMOS 邏輯閘引入 Phase Noise 和 Jitter 應該是在所難免，用方案四吧！

至少他們有保障雞皮噎死（GPS）的應用無虞，這是 2.5ppm 以下的精準度。

hao2012 · 发表于 2017-3-4 15:50

超級狗发表于 2017-2-28 11:34% q# x" ~" B: s0 ]& `, I% c
方法四︰
- t z! d1 s$ l0 z有一種叫 Clock Buffer 的哀西，這種哀西很多，Cypress 和 SiliconLabs 好像也有。

狗大，看了那个TI的clk buffer CDC3RL02，里面没有明确说两路输出没有相位差啊？这种结构的buffer都是同相位的吗？

超級狗 · 发表于 2017-2-28 11:18

本帖最后由超級狗于 2017-2-28 11:24 编辑

方法一：0 B' D: s8 u7 `. l2 ~6 y$ p

超級狗 · 发表于 2017-2-28 11:22

方法二：

超級狗 · 发表于 2017-2-28 11:27

方法三：

超級狗 · 发表于 2017-2-28 11:34

方法四︰
有一種叫 Clock Buffer 的哀西，這種哀西很多，Cypress 和 SiliconLabs 好像也有。

超級狗 · 发表于 2017-2-28 11:53

附帶說明：
以上方案是某 TCXO 供應商，搭配賽靈思（Xilinx）所出版的應用指南（Application Note）。

超級狗 · 发表于 2017-2-28 12:35

本帖最后由超級狗于 2017-2-28 12:39 编辑

忘了提醒樓主！

74HC 系列的傳輸延遲（Propagation Delay）大概就在 25ns 上下，換句話說最大的工作頻率只有 40MHz 左右。所以如果要使用外部邏輯閘電路，最好選用 74AHC 系列。

张湘岳 · 发表于 2017-2-28 15:03

超級狗发表于 2017-2-28 12:35' R. P9 k0 x. j2 U
忘了提醒樓主！
# s# p. {0 f" s6 Y- D4 H9 ~5 e& Y+ @8 h$ C( D$ g2 }6 t
74HC 系列的傳輸延遲（Propagation Delay）大概就在 25ns 上下，換句話說最大的工作頻率 ...

版主真乃高人,什么都能找到资料,有理有据

松哥无敌 · 发表于 2017-2-28 17:21

版主真乃高人,什么都能找到资料,有理有据

hao2012 · 发表于 2017-3-1 09:13

超級狗发表于 2017-2-28 11:18
: _1 o9 D; u1 @方法一：

谢谢版主回答这么仔细。狗大还有一个问题：这些用反相器的电路不知道能不能引入误差啊？晶振本来稳定度很高都是1.5，2ppm，用这些反相器会不会使它稳定度变差啊？

超級狗 · 发表于 2017-3-1 20:14

SEIKO/EPSON TCXO for Xilinx Stratum III

超級狗 · 发表于 2017-3-1 20:18

Isotemp TCXO for Xilinx Stratum III

超級狗 · 发表于 2017-3-1 20:23

IDT Ultra Low Jitter Single-Ended Clock Buffer

看起來也不錯！

KERYHE · 发表于 2017-3-1 22:44

好东西，谢谢，学习了

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