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我画完原理图后，生成网络表，在PCB中导入网络表布局的时候发现这样的问题：两个器件分别放在底层和顶层，但是要重叠放，这样为什么显示绿色的呢？并且进行DRC检查是出现这样的错误：% ]% W2 `% B( d9 v" ^" N1 t! q
Violation Net P1.1 is broken into 2 sub-nets. Routed To 0.00%8 q1 m5 ~& K+ m' l, d6 v! y* l6 s
Subnet : JP3-8
: ?& G0 o5 n! t& ~3 B Subnet : U1-2
) V8 W+ p/ R# S, ^9 d Violation Net P1.0 is broken into 2 sub-nets. Routed To 0.00%' Z, e9 t) j% s
Subnet : JP3-7 2 L8 }- \) p1 E' n& L1 d
Subnet : U1-1 / P) m9 B% X* ] E6 W$ L) n
Violation Net P0.4 is broken into 2 sub-nets. Routed To 0.00%
/ x, I- P) {1 V/ n; A- a7 e0 { Subnet : JP2-10
0 ~& j0 C0 ~! M. a% G Subnet : U1-35
, u3 _; M+ J$ |3 ?2 _: _+ V! |5 { Violation Net P0.3 is broken into 2 sub-nets. Routed To 0.00%
! i# p. K8 a5 S# | Subnet : JP2-8
5 s O2 I9 a5 } \1 t9 ~) _ Subnet : U1-36 , W" _* ^+ s3 s0 T+ G* ~9 S% R
Violation Net P0.2 is broken into 2 sub-nets. Routed To 0.00%
' a; a& ~( V! L: C Subnet : JP2-6 1 F" o1 Y) i- R9 s5 B
Subnet : U1-37 9 P/ B+ E6 S. b! z+ _
Violation Net P0.1 is broken into 2 sub-nets. Routed To 0.00%
3 ~# M/ [; m; i/ I* g( ? Subnet : JP2-4 % v- |! C& L0 u3 T; \' j
Subnet : U1-38
) G* E& C9 v/ f5 {: f Violation Net P0.0 is broken into 2 sub-nets. Routed To 0.00%
& F! Y( [% u+ y% }9 ~7 k Subnet : JP2-2
8 Y% v7 r! n0 q: y* h Subnet : U1-39 4 _, m, o! a, A5 D$ T9 b
Violation Net NetY1_2 is broken into 3 sub-nets. Routed To 0.00%
( Q' B. x4 Q4 }& T" @( G0 T5 S% Z Subnet : U1-18
7 Y# i# r8 u' l7 l- o) M6 N Subnet : Y1-2
% U9 _" q4 R5 z$ `请问这是什么原因啊？需要进行什么设置？谢谢！, { |' Z/ z8 d4 T! Q4 I% s
图片在附图中：$ A8 |2 L7 V9 b' r2 g) l1 D
Y1,SW5,SW6,U1在底层，u1在底层，这样画为什么会出现绿色呢？请不吝赐教，谢谢！ |
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发表于 2008-11-30 21:08
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