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请教Allegro规则设置

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gavinhuang

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发表于 2017-1-17 11:52 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 gavinhuang 于 2017-1-17 11:58 编辑 3 H+ m6 k2 n: _

/ R7 V1 Z/ z! {. l3 z7 m. N如下图一，差分信号从UA1发出，经过U1，到达RJ45_USB2连接器。U1的第4pin和第5pin是同一网络，第3pin和第6pin是同一网络，以此类推。+ Z$ [, J4 h' j! s' O# B  g
这种情况下，拓扑结构如图二所示，请问设置等长约束的时候，我怎么设置才能正确的得到UA1 -> U1 -> RJ45_USB2之间的走线长度？& ~! c/ X  b3 u* w9 v% A2 V
多谢各位！
& z/ V+ h0 o5 k7 ~ 9 u: k5 O' J$ o

! t6 Y' k/ d5 F  ~- G2 K: B" ]) ] 4 I' s( u* k, p' y  V
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jacekysun

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发表于 2017-1-18 08:28 | 只看该作者
直接设置pinpair，UA1---RJ45_USB2，中间的可以忽略啊

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bingshuihuo
楼主 正解！！！  详情 回复 发表于 2017-1-18 09:35

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J蓝虹

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发表于 2017-1-17 12:52 | 只看该作者
修改拓扑成UA1 -> U1 -> RJ45_USB2

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gavinhuang
你好，怎么修改？给U1赋以什么样的器件模型？  详情 回复 发表于 2017-1-17 13:25

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gavinhuang

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 楼主| 发表于 2017-1-17 13:25 | 只看该作者
J蓝虹 发表于 2017-1-17 12:52/ P- j" e9 N  e3 s/ n+ P$ X
修改拓扑成UA1 -> U1 -> RJ45_USB2
6 }% _; m0 {  z+ A/ K
你好，怎么修改？给U1赋以什么样的器件模型？$ H& p9 l. ^! I( }6 P  o  a2 I

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J蓝虹
单纯设rule的话不需要，把线断了，调一下这三个的位置，重连完事。然后再设constraint就可以了。否则会有ET DRC  详情 回复 发表于 2017-1-18 11:17

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djadfas

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发表于 2017-1-17 14:21 | 只看该作者
这不是差分对走线么   还设置等长干嘛？

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wshna0221

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发表于 2017-1-18 09:28 | 只看该作者
楼上在解
8 i/ b3 B  q5 D/ S

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bingshuihuo

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发表于 2017-1-18 09:35 | 只看该作者
jacekysun 发表于 2017-1-18 08:28
- ?7 ^5 @  a' h9 U: q" ~直接设置pinpair，UA1---RJ45_USB2，中间的可以忽略啊

: F( r6 R7 Y: J1 p) d, e楼主 正解！！！& r( s0 L. L# I% @5 f7 U2 V

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J蓝虹

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发表于 2017-1-18 11:17 | 只看该作者
gavinhuang 发表于 2017-1-17 13:25
# b! }$ Z1 o  M! G你好，怎么修改？给U1赋以什么样的器件模型？

+ A+ J# h# {" l: D' C  D单纯设rule的话不需要，把线断了，调一下这三个的位置，重连完事。然后再设constraint就可以了。否则会有ET DRC
' d, g. z0 m- T5 r7 T0 ~% W

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li262925

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发表于 2017-1-18 13:14 | 只看该作者
支持pinpair    UA1---RJ45_USB2

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妞妞麻吉12

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发表于 2017-1-19 10:53 | 只看该作者
可以设X-NET

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suiwinder

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发表于 2017-1-19 13:01 | 只看该作者
应该是条条大路通罗马，都可以的

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hey66880

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发表于 2017-2-7 23:10 | 只看该作者
如果不用做分段等长就直接设第一个点到最后一个点，如果需要做分段等长就需要设X NET。CM的设定一旦想通了其实很简单。

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