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DDR SDRAM绕等长

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发表于 2016-7-4 08:12 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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有谁有关于DDR、SDRAM绕等长的资料呢,求分享
4 Z2 E& R* e0 D2 g
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发表于 2016-7-4 09:05 | 只看该作者
你想知道什么呢??等长间的误差吗??

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越详细越好,要是有原理说明就更好了,比如上升沿采样等?  详情 回复 发表于 2016-7-4 10:10
频率 等长误差一般设置范围等  详情 回复 发表于 2016-7-4 10:09

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 楼主| 发表于 2016-7-4 10:09 | 只看该作者
980155498cai 发表于 2016-7-4 09:05' O$ q( g' v4 g
你想知道什么呢??等长间的误差吗??
9 K' P$ x9 X4 f0 ^8 d: u
频率  等长误差一般设置范围等- Y, v  D: A9 q* x- Y  F9 ?% v

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SDRAM速率不高,误差可以大一点50mil左右,  详情 回复 发表于 2016-7-4 10:55

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 楼主| 发表于 2016-7-4 10:10 | 只看该作者
980155498cai 发表于 2016-7-4 09:05
* [% w# p# `; U0 S" s& I你想知道什么呢??等长间的误差吗??
; w5 k% ]4 t4 B
越详细越好,要是有原理说明就更好了,比如上升沿采样等?
' s" p* _9 u: g- A. T
+ X8 l% w$ i, j2 x# z3 [

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发表于 2016-7-4 10:55 | 只看该作者
shipaopao 发表于 2016-7-4 10:09
: {( _( @3 g# Y4 Y$ f频率  等长误差一般设置范围等

+ e- x9 g, ~+ J7 cSDRAM速率不高,误差可以大一点50mil左右,

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发表于 2016-7-4 11:23 | 只看该作者
我也想知道,来看看

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发表于 2016-7-4 16:14 | 只看该作者
数据10mil,地址20mil
没有画不出的板!个人主页:feiyudy.com

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发表于 2016-7-5 17:03 | 只看该作者
同一组内DQ与DQS的走线延时差异不得超过+/-5ps8 b& O" o+ _. q$ v
地址、控制信号与CK的走线延时差异不得超过+/-25ps/ y8 m2 ?: G2 l. Y6 j& i# I
对每个DDR3芯片,CK必须晚于DQS到达,延时差值范围0~250ps        我一般data±5 add±100
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