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[仿真讨论] Hyperlynx DDR时序模型如何建立

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发表于 2017-12-5 10:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近在学习用Hyperlynx仿真DDR,对时序模型的建立有一些疑问,还请各位指教:
' z# \8 x; @! }0 _0 F9 @1、如果想自己建立DDR的时序模型,里面的各个参数值怎么设置?看了Mentor的技术文档(比如tACCSkew,tCKDQS, tDQSDQQ, tDH, tDS这些值是哪来呢),2 w& V* ^0 ^5 D/ R) P
还是云里雾里的,大家有没有这方面的资料可以发出来共享一下呢?
# u% V+ a1 b! X" |/ J* X2、如果用标准的时序模型,看了hyperlynx安装库里面有很多时序文件,这些文件有什么区别呢?5 S' p% R/ t0 K
看了一下感觉里面定义的内容不太一样,我在仿真的时候要如何选择时序模型呢?$ i/ o2 I2 N, e+ x- C5 m' l
感觉自己看资料进展很慢,遇到问题就进行不下去了,希望能得到高手的指导,谢谢大家
! Z: K) ]: _& Z" d9 L: U9 B

1.png (43.41 KB, 下载次数: 1)

安装库里的时序文件

安装库里的时序文件
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发表于 2017-12-5 15:28 | 只看该作者
1、那些参数可以找芯片手册看
) v4 D3 K8 i1 R$ ^2、hyperlynx 仿DDR有向导的,按步骤就可以了吧,一般可以按默认的
' c" X1 z. \0 A/ T
1 W! G& b2 p# W
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
日飘渺 夜惆怅 醉眼朦胧 真心人赢得天下输了她

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发表于 2017-12-5 15:42 | 只看该作者
论坛上有相关资料,可以搜索关注下+ F6 h$ t" _4 v: t% C

2 [) |3 ~% r; X7 \& T$ H( A* w6 K$ {https://www.eda365.com/forum.php? ... amp;_dsign=780c4edf
$ S: t3 u; T" }8 i2 a, F" {' `# M* Hhttps://www.eda365.com/forum.php? ... amp;_dsign=7f4ebb63
1 l# z& Z2 h) H0 S* Z$ M; H, Ihttps://www.eda365.com/forum.php? ... amp;_dsign=b91e4bb2
8 z! O1 }' k" D% i

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发表于 2018-1-5 09:11 | 只看该作者
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发表于 2018-1-7 17:06 | 只看该作者
hyperlynx仿真DDRX时 MCP无法加入 需要删除NAND的走线吗

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发表于 2018-4-11 11:22 | 只看该作者
xingnuolgsx 您好  tACCSkew是來自controller 的  data sheet,tCKDQS是clock跟DQS的skew,是由 tDDKHMH導出,而 tDQSDQ(min) and tDQSDQ(max) 是由 tDDKHDS或tDDKLDS跟 tDDKHDS或tDDKLDX導出,tDH, tDS是DDR flip flop的setup time 跟 hold time,在memory端,JEDEC有統一規定,在controller端就要看各晶片的datasheet。詳細的定義可以看Hyperlynx user guide 第5章 Simulation Results(9.4版以後),若是9.3版以前,請看第12章 Simulating DDRx Memory Interfaces。

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发表于 2018-4-22 13:24 | 只看该作者
:):):):):)

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发表于 2018-5-10 14:58 | 只看该作者
:lol:lol:lol
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