帮忙指导下ddr2时钟线上的短接电阻阻放在什么位置最合适

eda1057933793 · 发表于 2015-7-24 17:47

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本帖最后由 eda1057933793 于 2015-7-24 17:53 编辑

如图为一带二的颗粒，是ddr2，目前拓扑为t点形式，时钟上的端接电阻放在哪个位置最好？是第一级的t点吗？大家有具体仿真数据吗？谢谢！

菩提老树 · 发表于 2015-7-25 14:43

如果是上拉，就放在第一级

eda1057933793 · 发表于 2015-7-28 13:49

菩提老树发表于 2015-7-25 14:43, U6 E5 o# {/ W- `
如果是上拉，就放在第一级

不是上拉哦，是接在时钟n p上的电阻。

菩提老树 · 发表于 2015-7-28 17:53

eda1057933793 发表于 2015-7-28 13:49% ~+ D c: V; L/ ]$ d3 r
不是上拉哦，是接在时钟n p上的电阻。

靠在接收端就好啦

cousins · 发表于 2015-7-28 18:30

一般电路图上都会把这个电阻放在DDR颗粒的那一页，你应该想到这不仅仅是个习惯而已

hhawwl · 发表于 2015-8-12 17:11

版主正解！

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