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EDA365电子工程师网»技术社区 › 电子技术社区 › 电子硬件设计论坛 › 原理图芯片封装分布出错，导不了网表，请求帮助！
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原理图芯片封装分布出错，导不了网表，请求帮助！

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yangmingen

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发表于 2015-8-13 12:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如下图，source packag ， source part 的值与其它分页的不一样，导网表报错：9 S: U1 d$ y; d
1 T3 [' }0 x  Q2 n* z
Checking Pin to Port Connections
1 _$ v5 ~& }- v* ?) y& U! |8 Y* D0 K6 A7 h4 J
Checking for Invalid References( Z0 d7 q9 U) c
ERROR [DRC0026]   This reference has already been assigned to a different package type. U502:  SCHEMATIC1, 02.RX-LVDS&TX-MINILVDS  (1.72, 8.48)
( f2 a  s2 M# ]- I3 `2 ~$ M/ P3 B" s3 b
Checking for Duplicate References
$ Q* L: {7 I8 j9 A% Q: C7 a; j% y! B1 |! J  k
( O4 G6 g  f2 y& H6 z2 o
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fallen

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2#
发表于 2015-8-13 13:42 | 只看该作者
同一器件的不同部分吗？+ C8 W. a- e$ f' c2 }( Q
那么应该是位号要一样，后面再加ABCD....4 ^0 B/ Q, v2 f9 d4 T0 I3 C( G. \
) d7 J+ K& T0 K. x8 t
另外你这个问题，可以从其他正确的地方复制一个过来，然后再改后缀。

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kevin890505

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3#
发表于 2015-8-13 15:18 | 只看该作者
把这个器件更新下就行了撒，或者直接替换为同一个源

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