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MentorEE 中,检查DRC时,总是数量检查不全,如何改设置呢?

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发表于 2015-7-6 15:12 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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检查DRC时,由于全层检查DRC过多,然后单层逐层检查,可是还是显示对话框,说数量过多,已上传图片,请大家帮忙看看怎么办?, y$ |/ H, ~! S% N# B* ~# E

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发表于 2015-7-6 16:30 | 只看该作者
你这是DRC错误太多了吧 ~超过了上限

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有些DRC是可以接受的,可以忽略,但是设置面不知道怎么改。  详情 回复 发表于 2015-7-6 16:33

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 楼主| 发表于 2015-7-6 16:33 | 只看该作者
蚂蚁乱舞 发表于 2015-7-6 16:309 y- W( T  n; G" x2 V" d* ]
你这是DRC错误太多了吧 ~超过了上限
1 _7 }+ L0 [3 ^" Z
有些DRC是可以接受的,可以忽略,但是设置面不知道怎么改。
5 }6 z+ I( C& X; O

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发表于 2015-7-6 21:35 | 只看该作者
分多次检查不要一次检查太多选项,不如只检查短路啊,开路啊阻焊露铜啦等

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好的,谢谢  详情 回复 发表于 2015-7-7 11:46

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 楼主| 发表于 2015-7-7 11:46 | 只看该作者
haoyingxiang 发表于 2015-7-6 21:35& e0 i* x$ P* |  X' |! z. B* r. C
分多次检查不要一次检查太多选项,不如只检查短路啊,开路啊阻焊露铜啦等

" L; S* r$ o8 }2 r7 F! _+ _$ ]' V好的,谢谢

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发表于 2015-7-11 15:12 | 只看该作者

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发表于 2015-7-11 21:08 | 只看该作者
如果错误太多,建议Btch DRC检查时分开检查,先跑Connectivity and special rools检查,然后再跑下方其它项目的检查。在ces中间距规则设置下把plancement outline之间的间距设置为0可以省略掉不少DRC。

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CES里面没有设置placement outline的选项啊!只能从DFF里面改数值。  详情 回复 发表于 2015-7-13 10:36

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 楼主| 发表于 2015-7-13 10:36 | 只看该作者
lonely 发表于 2015-7-11 21:08
  @  ~; [+ \  W0 b2 S  z+ P* i如果错误太多,建议Btch DRC检查时分开检查,先跑Connectivity and special rools检查,然后再跑下方其它项 ...
2 _% L8 Y& \0 r3 ?
CES里面没有设置placement outline的选项啊!只能从DFF里面改数值。
6 q' B' V$ A& L0 N% Y- C4 v- r6 ?
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