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我做的ddr2布线,我分了4个class,请问每个class之间的规则这么来设置呢?我要做4层板

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发表于 2012-4-27 14:34 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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我做的ddr2布线,我分了4个class,请问每个class之间的规则这么来设置呢?我要做4层板5 B7 [! M- X% u/ Q

6 b1 _. ~' K) j& F3 W  H大侠们帮忙看下,粉色想地址命令,绿色是高八位数据,淡黄色是低八位数据线

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TM截图未命名.png
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 楼主| 发表于 2012-4-27 14:37 | 只看该作者
线宽我用的是5mil。via用的是20/10和16/8,这样可以吗?

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发表于 2012-4-27 14:55 | 只看该作者
过孔可以采用:8/18,8/16(ddr)$ W% [; f1 x5 }2 ]  }( |

& w0 A% ~3 I6 z" e$ Z线宽要根据你的阻抗值,层叠,铜厚,表面处理工艺等来计算。可用SI8000来算。
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 楼主| 发表于 2012-4-27 15:10 | 只看该作者
jimmy 发表于 2012-4-27 14:55
  _2 l: |$ z5 J, x. `过孔可以采用:8/18,8/16(ddr)2 ]# P1 @! K$ `" ?( C  l0 n1 N
: Z- d3 Z6 l* ?6 Q" J0 q# a
线宽要根据你的阻抗值,层叠,铜厚,表面处理工艺等来计算。可用SI8000来算 ...
1 v, g$ @# r; [. C8 W1 O6 m* d
这样的布线,数据线不可能都在同一层的,这样有问题吗?

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发表于 2012-4-27 15:26 | 只看该作者
没问题。如果没办法在同一层,那高低位一定要保证4w或20mil的间距
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 楼主| 发表于 2012-4-27 16:06 | 只看该作者
jimmy 发表于 2012-4-27 15:26 6 {9 F. W; O' z% U: p
没问题。如果没办法在同一层,那高低位一定要保证4w或20mil的间距
2 Y# H; Q) A, W) L9 |
哦,谢谢jimmy大哥哦

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发表于 2012-4-28 17:11 | 只看该作者
jimmy 发表于 2012-4-27 14:55 $ z* E+ C  w  x4 k( E6 E- j
过孔可以采用:8/18,8/16(ddr)  r- c+ h- Y! A6 p6 r9 [$ T# \
! a" z+ R0 d. b) P9 r$ _4 {$ f# h
线宽要根据你的阻抗值,层叠,铜厚,表面处理工艺等来计算。可用SI8000来算 ...

. W* X6 I2 S- _% G9 {; v过孔用8的话 成本很高。。。* a+ `5 s. M. c: A/ w# }
我们工厂告诉我 双面一般最小用10mil 我一般用12mil

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发表于 2012-4-28 21:21 | 只看该作者
4层板啊,成本怎么高呢?你板厚多少?
ECAD 攻城狮,邮箱:jack2021@163.com

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发表于 2012-4-29 08:51 | 只看该作者
rjc 发表于 2012-4-28 17:11 * ?9 ?: W  ^# v9 c: b
过孔用8的话 成本很高。。。+ _. c! A3 s" h9 z4 }
我们工厂告诉我 双面一般最小用10mil 我一般用12mil
6 m  e: ^" \  b4 A' N
你听板厂虾扯蛋。DDR是0.8mm的间距,用10~12mil的孔你还怎么走线。
' [) |7 e! v9 I3 f+ z1 j! y! k; o7 v& N
建议你换一家板厂。
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发表于 2012-4-29 23:59 | 只看该作者
具体一点是怎么分4个class的? 过孔用16d8 20d12就可

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 楼主| 发表于 2012-5-2 12:54 | 只看该作者
adwordslai 发表于 2012-4-29 23:59
5 d# L; N# M8 u具体一点是怎么分4个class的? 过孔用16d8 20d12就可

0 m" e2 F, i- T4个class如下:
% v2 E( P* c5 g; v
8 y0 b  i, }  J: \2 H- n! g  D1,DATA_L:Q0~DQ7,LDM,LDQS_N,LDQS_P1 L' l; B" H  a, C) G
. t6 L$ G( y+ B3 {
2,DATA_H: Q8~DQ15,UDM,UDQS_N,UDQS_P  U5 }3 p: ]8 l6 D# f4 |
4 u6 \: f/ [$ f/ g- f% U
3,ADDR:除数据线外的其他信号,AO~A15,BA0~BA2,CAS_N,CKE,ODT,RAS_N,WE_N7 R4 t: A' O9 b# M# p2 k

" U# A9 P; x. U- a6 [4 `( x4,CLK_DIFF: CLK_N,CLK_P

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 楼主| 发表于 2012-5-2 12:56 | 只看该作者
Happyboy168 发表于 2012-4-28 21:21 ) [. D3 S( U; K
4层板啊,成本怎么高呢?你板厚多少?

$ j+ t7 ^$ a+ j  w- `) |板厚1.6mm

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发表于 2012-5-3 10:01 | 只看该作者
你的class设置得对,只要1,2,3组基本等长,(+-100mil)差分线严格等长(+-10mil),基本上没什么问题了。

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发表于 2012-5-6 22:07 | 只看该作者
看看

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发表于 2012-5-9 17:50 | 只看该作者
我正在layout DDR3x8x4,内存 1G。由于板子较小只有3x6CM,所以我采用过孔是VIA-12-4,6层板设计。LZ Class 分组基本OK了,时钟布线要包地或者考虑3W原则
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