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logic生成PDF后元件的虚框怎么不要?

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发表于 2015-4-16 11:36 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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RT,虚框看起来会遮住电路,有没有什么办法可以选择不要?
3 n6 v/ V' U% l- }$ R( U1 C6 `

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发表于 2015-4-16 11:53 | 只看该作者
属性里把对应的勾去掉

点评

有对应的名称吗?元件属性里我没看到相应的选项是来设置生成PDF后是否显示虚框。  详情 回复 发表于 2015-4-16 12:26
听党指挥,能打胜仗,作风优良

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 楼主| 发表于 2015-4-16 12:26 | 只看该作者
flywinder 发表于 2015-4-16 11:53
" x, Q$ L6 E5 i! k  d5 R属性里把对应的勾去掉

. }3 F: \; w# ^4 h有对应的名称吗?元件属性里我没看到相应的选项是来设置生成PDF后是否显示虚框。

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发表于 2015-4-16 17:26 | 只看该作者
1 {# Q, a  Y$ _
专业服务:(价格面议)
代写作业
拉等长
调丝印
喂猪
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打老师

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发表于 2015-6-18 11:43 | 只看该作者
只需要在生成PDF时候把超链接下面的两个选项不勾就行了。不用改属性
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