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关于ddr3的走线及绕线规则

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发表于 2012-6-30 08:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 紫菁 于 2017-9-14 11:20 编辑 * h" Y6 h; N. G# h0 w( p5 I" H
- v3 L( b  C6 Q+ r4 J" U, N
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发表于 2017-3-23 10:43 | 只看该作者
好希望哪位大神能出DDR布线的视频啊
7 p' y" I7 M+ q! M

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发表于 2017-12-3 21:26 | 只看该作者
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发表于 2012-6-30 13:05 | 只看该作者
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发表于 2012-6-30 13:16 | 只看该作者
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发表于 2012-7-1 08:46 | 只看该作者
求教下  ddr3 走线的拓扑跟跟自身的颗粒数有关吗  如果是 四个颗粒 速率再400M  那走T形拓扑有问题吗

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发表于 2012-7-1 10:03 | 只看该作者
EDADQP 发表于 2012-7-1 08:46
0 i) C* L9 \$ X  X6 S) b求教下  ddr3 走线的拓扑跟跟自身的颗粒数有关吗  如果是 四个颗粒 速率再400M  那走T形拓扑有问题吗
4 @6 h7 e8 u5 n) A
DDR3都是采用fly_by的结构,不建议采用T型连接

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发表于 2012-7-1 22:55 | 只看该作者
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发表于 2012-7-2 09:26 | 只看该作者
感谢分享!辛苦了!

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发表于 2012-7-2 09:50 | 只看该作者
谢谢分享

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发表于 2012-7-2 10:37 | 只看该作者
谢谢分享。如果PCB上芯片的轮廓更清楚地话,就更好了。

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发表于 2012-7-2 13:31 | 只看该作者
谢谢分享 % C- q: ]$ y& F/ F- E* g

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发表于 2012-7-8 00:17 | 只看该作者
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发表于 2012-7-9 23:06 | 只看该作者
好东西呀,不过DDR2还没搞明白呢
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