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DDR2数据线顺序

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发表于 2013-10-8 16:17 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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最近做项目遇到一个问题,还请各位大侠赐教。
5 I# `8 V# d% p; z. a( c0 TDDR2用的是NT5TU32M16DG,ARM用的是ST的STA2165。& L1 `: B& \; Q8 c; t9 A" J
ARM与DDR2之间的数据线顺序,一开始画原理图时按照对应关系来接的,DDR2的DQ0接至ARM的DQ0,以此类推,DDR2的DQ15接至ARM的DQ15,也按照这个连接关系布PCB,板子出来后调软件发现DDR2这块怎么也调不通。, ?1 e/ A4 b$ B0 H) Q; H( i9 W
后来检查原理图,发现推荐的原理图DDR2和ARM的数据线顺序并不是一一对应的,而是ARM的DQ[0:7]对应到DDR2的DQ[8:15],ARM的DQ【8:15】对应到DDR2的DQ[0:7],而且两个字节内的线序也是打乱的。
5 y" n8 L4 F! d" ~7 L, J5 v! w跟ST原厂的沟通了,说我们之前的接法是错误的,必须按照他们推荐的顺序接,
% o" L+ g  }, W/ h5 P! d在网上查了,有人说为了便于PCB走线,数据总线可以乱序相接,但为什么我按照DDR2的pin脚定义顺序接就不行呢?哪位大侠能帮忙解释一下原因,先谢谢啦!

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数据乱序相接是在同一组情况,DDR[0..7] DQS0 DM0必须在同一组。  发表于 2013-10-9 15:03
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发表于 2013-10-8 17:45 | 只看该作者
字节内的顺序更改是不用改软件的,但是字节之间的更改是需要软件做相应的改动的,也许是ST考虑这样改动layout会比较顺,也许真的是PIN MAP错了,不过后者可能性好像不是很大,如果都知道是错的,肯定是要改的啊。

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发表于 2013-10-8 17:20 | 只看该作者
凡事没有决对,只是原厂不乐意帮你改。评估一下,是新做板划算还是请他们帮改一下划算。

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说在点上!  发表于 2013-10-9 09:26

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 楼主| 发表于 2013-10-9 15:47 | 只看该作者
tzljbj 发表于 2013-10-9 15:01
- m- D( A" [4 P6 n% Z5 S* C7 D$ I你的问题跟线序没有关系,而是DDR[0:7] DQS0 DM0不在同一组。这个是没法解决的。改版吧。
, T& C$ F  R8 C9 d! x$ F
你的意思是DQ[0:7]必须和DQS0 DM0在同一组,DQ[8:15]必须和DQS1 DM1在同一组,而我原来的接法是相反的,是这样吗?
+ b9 M* h& p3 Y$ n' V# i% {如果这样的话,是不是DDR的数据总线顺序跟DDR芯片本身pin定义的顺序没有关系,完全由ARM来决定,是这样吗?

点评

DQ【0:7】组内数据线可以随便调整,因为DDR是以字节为单位的。但是DQS0 DM0是DQ【0:7】的使能、锁存时钟信号,必须是同一组。  发表于 2013-10-9 16:17

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发表于 2013-10-8 16:32 | 只看该作者
无图无真相,先把图贴出来
  Q2 B/ I. v2 i& Q% v

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 楼主| 发表于 2013-10-8 16:42 | 只看该作者
allen_ying 发表于 2013-10-8 16:32
; J5 L* v, c4 b+ V2 _无图无真相,先把图贴出来
& ]7 R4 b* f9 x7 ?3 G' _  t
fig1是原来的图,fig2是ST推荐的图。

fig1.jpg (98.38 KB, 下载次数: 3)

fig1

fig1

fig2.jpg (68.95 KB, 下载次数: 0)

fig2

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发表于 2013-10-8 16:54 | 只看该作者
你出的图都没法看清。如果真是高低位接反了,就找软件改改DDR驱动吧。

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 楼主| 发表于 2013-10-8 16:56 | 只看该作者
allen_ying 发表于 2013-10-8 16:54
. }8 Y: k  C# `8 Y5 ^+ ~9 F你出的图都没法看清。如果真是高低位接反了,就找软件改改DDR驱动吧。
- U) d* D1 x1 N! V/ A. p
问题是ST的人说改软件不行,必须按照他推荐的顺序接,不知道什么原因。

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发表于 2013-10-8 17:00 | 只看该作者
字节内是可以任意打乱的,这是因为字节是最小存储单元,D0~D7(或D8~D15)8根线按什么顺序存入,那么当按相同的顺序取出时,取出的字节当然和你存进去的字节一样的。* e$ b% b* x" ?- y- g8 g

0 }) ~+ j/ E( L. w$ g  QD0~D7和D8~D15两组对调,也许人家原厂的程序是必须这样的呢。既然原厂说是对的就是对的。

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发表于 2013-10-9 12:24 | 只看该作者
估计原厂为了显示自己的权威性,不想改软件。
专业服务(价格面议):
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吃鱼

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发表于 2013-10-9 14:18 | 只看该作者
这种情况,楼上有兄弟说的对,就是软件驱动的逻辑关系与硬件的物理逻辑对应关系的问题,应该随便修改其中之一都能解决的!!

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发表于 2013-10-9 15:01 | 只看该作者
你的问题跟线序没有关系,而是DDR[0:7] DQS0 DM0不在同一组。这个是没法解决的。改版吧。

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发表于 2013-11-4 16:20 | 只看该作者
ST这种原厂都是这样,产品厂家要按照他推荐的做,不然产品出来会遇到各种问题,稳定性、死机或者各种莫名其妙的问题,他们都会往这上面扯,说没按照他们的来。
+ r+ m# e" l2 R' W9 ~" |7 X2 e( H他们一方面是要是一个厂家一个做法,他们不方便维护,也不方便出底层软件。

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发表于 2013-11-25 15:52 | 只看该作者
kobeismygod 发表于 2013-10-8 17:45' G* \4 G6 J' U/ ]* S) A8 p
字节内的顺序更改是不用改软件的,但是字节之间的更改是需要软件做相应的改动的,也许是ST考虑这样改动layo ...

. v$ `% _9 o8 }3 ?请教你下,为什么字节内的顺序更改是不用改软件的呢?顺序乱了,不修改软件数据接收的时候不也乱了吗?请指点,谢谢。!

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发表于 2013-11-26 14:05 | 只看该作者
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