[Ansys仿真] 板级带状线仿真，阻抗问题

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发表于 2012-8-1 17:04 | 只看该作者

karen842 发表于 2012-8-1 12:56
- U) ~' `* @$ _, _1.TDR时间轴显示的时间应该是传输线时延的2倍吧？- ^# Q7 l, M. H0 X1 V
$ k5 W6 a4 u; w
从公式来算，Tr=0.6ns

假设介电常数是4，信号的速率应该是光速的二分之一，即150mm每ns，那么传输线时延应该是0.33ns，我觉得是这样的。
如果信号线只在两端有过孔，那阻抗还是很好分析的，但是如果传输线上还有别的元器件，就有点乱了，我在这方面还是很欠缺的，希望以后我们可以互相讨论，呵呵。

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