有人能解释下这个图吗

cmos · 发表于 2008-8-14 16:45

原帖由 Allen 于 2008-7-10 20:55 发表
7 K5 ~! w* j: H$ }+ y% \, y. B- D' |1 j: M2 p
作者不是牛得不行就是菜得不行

应该是菜的不行。

古罗马 · 发表于 2008-8-21 17:08

举双手赞同！！

mengzhuhao · 发表于 2008-8-21 18:38

说不定是焊接测试勾什么的连地

lwcit · 发表于 2008-9-5 15:49

最初以为是top 层有IC ，认为是IC 内部定义独立的ground pin相互连接，再单点和GND相连，后看到内层有一对diff trace，认为是在两侧加的GND via。至于将via穿起来，像是恶搞，没有意义

31330023 · 发表于 2008-10-30 17:59

有点像改板,上一板电容的fanout...改板删了电容没有删去走线和孔的

forevercgh · 发表于 2008-10-31 09:18

原帖由 ccddll 于 2008-7-11 16:27 发表 $ ~2 O( m i& A) d, q) Y
这是人freescale的一个开发板图嘛7 B9 Y# d- A) N/ w8 g- r; G
不会这么无聊在上面涂鸦吧

不要觉得fresscale就如何如何，上次见到几个cypress的板子，USB走线相当不规范，和他们的layout guide就严重不符。
其实想想，大公司分工是很明确的，制定guide和layout应该不是同个人了，比较烂的demo板出现也是正常。

emanule · 发表于 2008-10-31 15:42

原帖由 forevercgh 于 2008-10-31 09:18 发表 $ ~3 x$ ~4 K3 r6 [% ?. q& s
3 y. R0 X% v8 D W6 g/ `
0 I5 R% W% [" c. t9 D7 ]
不要觉得fresscale就如何如何，上次见到几个cypress的板子，USB走线相当不规范，和他们的layout guide就严重不符。* V7 z/ ~) _" B, i- ?
其实想想，大公司分工是很明确的，制定guide和layout应该不是同个人了，比较烂的demo板出现也 ...

有同感 Demo 板子就是有不规范的地方，只要他们的FAE没发现呵呵

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有人能解释下这个图吗

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