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EDA365电子工程师网»技术社区 › 电子技术社区 › PADS论坛 › 4片DDR3等长请教
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4片DDR3等长请教

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liuchao6102616

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发表于 2018-3-16 11:07 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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没有做过DDR3的PCB Layout 查了一些资料  请教几个问题：如图  单片分组：数据组1  数据组2   地址命令控制时钟一组  ) C! T) K4 h4 D, l5 O9 Q+ A' V
问题1： 单片中数据组1和数据组2之间需要误差要控制多少？
3 a# U+ R+ V7 N" \' G: B0 [问题2： 地址命令控制时钟组内等长误差控制多少？
8 M+ M& K2 f" X1 v2 T  @问题3： 地址命令控制时钟组合数据组间等长误差控制多少？1 r. w" E1 e# G7 J# }
问题4： 每片DDR3之间是否有等长要求？1 E) K7 B2 J2 O- p
望大神们指教  感谢！  
1 g7 h1 f$ |1 D' G+ G# [- _4 X
" h3 i- J$ D, E$ S9 U( |
9 |  Q# r+ u6 u$ R8 c* b
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superlish

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版务助理

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发表于 2018-3-16 17:37 | 只看该作者
分组等长即可
七尺寒光凛冽！痛饮热血四方！

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baby_snow11

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发表于 2018-5-18 22:33 | 只看该作者
学习了

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