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[HyperLynx] DDR仿真网络选择

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发表于 2018-1-11 17:30 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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使用DDR仿真的时候,选择数据网络的时候为何DQ/DM分一起,见图中箭头处。是哪里出错了,如何改正?求教
& n7 k! S, a4 S; A1 B

2018-01-11_17-24-33.jpg (189.53 KB, 下载次数: 2)

2018-01-11_17-24-33.jpg
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发表于 2018-1-13 10:32 | 只看该作者
前面网络那一步没有问题吗?
( {9 o5 V* q+ t+ x; r/ S$ f& d
8 c# v! B* ?- D& ^* D

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没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。  详情 回复 发表于 2018-1-15 10:26

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发表于 2018-1-13 14:58 | 只看该作者
参考差分的形式,你的模型是不是有问题?定义了差分?

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有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?  详情 回复 发表于 2018-1-15 10:29
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
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 楼主| 发表于 2018-1-15 10:26 | 只看该作者
superlish 发表于 2018-1-13 10:32' {. \/ @. Q5 d$ `! j
前面网络那一步没有问题吗?

" `9 ~7 k2 V" O没有问题,就是软件自动定义仿真网络的时候就把四根信号两两分一起了,不知道是什么原因。4 g3 _& _5 F6 S

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 楼主| 发表于 2018-1-15 10:29 | 只看该作者
GHOST 发表于 2018-1-13 14:580 Z+ v0 E3 m3 T7 A, a
参考差分的形式,你的模型是不是有问题?定义了差分?

7 P. t# A  V3 j有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变化,应该是CPU模型带来的问题,这种情况怎么解决啊?模型里怎么查看?1 w+ |1 x. ], g( z# u9 V

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直接打开就可以看啊  详情 回复 发表于 2018-1-15 11:53

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发表于 2018-1-15 11:53 | 只看该作者
dhgchina 发表于 2018-1-15 10:29
0 i9 B5 n: x9 I; |2 ]0 ~4 g有这种可能,我也怀疑是模型带来的问题,CPU厂家给的模型,DDR3自己网上下载的,我换了三个DDR3发现没变 ...
' L0 d8 i! l5 H/ b
直接打开就可以看啊' }3 ?2 Y1 ~8 Z

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问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了  详情 回复 发表于 2018-1-15 20:27
打开看没问题啊,有什么解决办法没有?  详情 回复 发表于 2018-1-15 17:13
风萧萧 雨茫茫 秋水望穿 拉线路漫漫何时是尽头
日飘渺 夜惆怅 醉眼朦胧 真心人赢得天下输了她

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 楼主| 发表于 2018-1-15 17:13 | 只看该作者
GHOST 发表于 2018-1-15 11:53
5 ^# s% u8 d- _! X( D; b直接打开就可以看啊
% S# l  c: f5 f9 I" X& k
打开看没问题啊,有什么解决办法没有?/ y  C9 E, z3 }, m0 b5 S$ Q, a# R

2018-01-15_17-10-47.jpg (321.1 KB, 下载次数: 0)

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 楼主| 发表于 2018-1-15 20:27 | 只看该作者
GHOST 发表于 2018-1-15 11:53
7 t2 f3 I9 k$ M1 V* y; f直接打开就可以看啊

; k, j7 |  z: N  a问题解决了,确实是模型的问题,DDR3模型里面定义的差分管脚没对应,换一个模型解决了
% ]) [; l& f" d. W9 w2 Y, H$ c
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