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楼主: Trista
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ddr2跑不起来跟什么有关呢?

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发表于 2017-5-26 18:28 | 只看该作者
这三根是否是需要等长的?你这里差的好大啊  (有PIN延时吗?? DDR2就用单端1根DQS,有要求全等长的,不知道你这个芯片要求是什么的?)
  Y3 C  E3 p2 h; J  L  b9 A6 p2 J
( h9 B' h+ o* c0 S( z; o& v! X
$ O; M% K3 R8 d2 \. N- o. Z' e8 H* n- C* w( D3 v+ b

% Y) G9 Z' X9 F! o

点评

没有等长,你指的三条信号线是MDQS0,MDATA7和MDATA5.MDATA7和MDATA5是等长的  详情 回复 发表于 2017-5-31 15:30

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发表于 2017-5-27 10:19 | 只看该作者
你这个跑步起来很正常,一般时钟最长, 具体看芯片指南,有一些芯片,是数据线和时钟误差不能超过600. 。。 走线要满足3W 。。 最好把文件发上来看一下。 还要看平面完整。

点评

你好,不好意思,文件公司不让上传的!另外画的一个板子,数据也比时钟长,大概是在500MIL内,能跑起来,这个跑不起来的板子,结构有限制,板子太小,CLK时钟无法走比数据线长,现在怀疑是信号完整性问题,重新改板  详情 回复 发表于 2017-5-31 15:37

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发表于 2017-5-27 14:39 | 只看该作者
1. 间距不满足3W(常规设计),绕线起的包太窄了。7 A; x4 ^9 w7 @1 ]) Z2 s9 G
2.阻抗不连续,走线在变压器下方,没有参考平面。/ p3 I9 N8 ]! F+ a
3.常规地址线应该比数据线长的。

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发表于 2017-5-30 21:53 | 只看该作者
跑不起来要看看是速度上不去还是一点都跑不动,如果是一点都跑不动,,那就很有可能不是信号完整性问题。。看看硬件有没有问题,如果是速度上不去在去考虑干扰问题。

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刚问了硬件,具体是怎么跑不起来,他说就不知道怎么情况才解决不了!  详情 回复 发表于 2017-5-31 15:50
我只是单纯画板的,板子是硬件调的,你说的那些,我都不懂  详情 回复 发表于 2017-5-31 15:43

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发表于 2017-5-31 10:17 | 只看该作者
RJ45选自带变压器的,不要再额外加隔离变压器了

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 楼主| 发表于 2017-5-31 15:30 | 只看该作者
superlish 发表于 2017-5-26 18:28
/ f; r9 P+ r+ {这三根是否是需要等长的?你这里差的好大啊  (有PIN延时吗?? DDR2就用单端1根DQS,有要求全等长的,不知 ...

" E; Z2 q' W. G" \0 C/ C& X' q没有等长,你指的三条信号线是MDQS0,MDATA7和MDATA5.MDATA7和MDATA5是等长的' j! T& k4 T1 ]2 P" L

/ W* @! M2 I2 n& I" t

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 楼主| 发表于 2017-5-31 15:37 | 只看该作者
ALLEGROPCB 发表于 2017-5-27 10:19, y. J' n4 l1 e8 R7 A+ y: t
你这个跑步起来很正常,一般时钟最长, 具体看芯片指南,有一些芯片,是数据线和时钟误差不能超过600. 。。 ...
3 n5 i6 [1 E" D) u. _
你好,不好意思,文件公司不让上传的!另外画的一个板子,数据也比时钟长,大概是在500MIL内,能跑起来,这个跑不起来的板子,结构有限制,板子太小,CLK时钟无法走比数据线长,现在怀疑是信号完整性问题,重新改板,到时看看能不能跑起来3 d0 g* b9 F$ p9 {, o

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 楼主| 发表于 2017-5-31 15:43 | 只看该作者
jerryzhu 发表于 2017-5-30 21:53
6 o. F# J. l1 b# x; I跑不起来要看看是速度上不去还是一点都跑不动,如果是一点都跑不动,,那就很有可能不是信号完整性问题。。 ...
1 p7 z' Z9 q  y- O* W. ^# v
我只是单纯画板的,板子是硬件调的,你说的那些,我都不懂4 ^' B0 _, M0 M- z$ @, E

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 楼主| 发表于 2017-5-31 15:50 | 只看该作者
jerryzhu 发表于 2017-5-30 21:53
; J+ F. u, N7 k, _  M8 z跑不起来要看看是速度上不去还是一点都跑不动,如果是一点都跑不动,,那就很有可能不是信号完整性问题。。 ...

" ?* l) u, {9 Y4 |刚问了硬件,具体是怎么跑不起来,他说就不知道怎么情况才解决不了!; \- G0 Q9 N: h
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