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楼主: Trista
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ddr2跑不起来跟什么有关呢?

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发表于 2017-5-26 18:28 | 只看该作者
这三根是否是需要等长的?你这里差的好大啊  (有PIN延时吗?? DDR2就用单端1根DQS,有要求全等长的,不知道你这个芯片要求是什么的?)
! V; s' P; f$ y% z- q6 v/ T: U$ O, B% K/ X

" s4 i* ~1 x* Z' O8 m! {% \- y, A  q) ^' C) I6 o
" U( E+ H% W7 Y4 z2 e

点评

没有等长,你指的三条信号线是MDQS0,MDATA7和MDATA5.MDATA7和MDATA5是等长的  详情 回复 发表于 2017-5-31 15:30

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发表于 2017-5-27 10:19 | 只看该作者
你这个跑步起来很正常,一般时钟最长, 具体看芯片指南,有一些芯片,是数据线和时钟误差不能超过600. 。。 走线要满足3W 。。 最好把文件发上来看一下。 还要看平面完整。

点评

你好,不好意思,文件公司不让上传的!另外画的一个板子,数据也比时钟长,大概是在500MIL内,能跑起来,这个跑不起来的板子,结构有限制,板子太小,CLK时钟无法走比数据线长,现在怀疑是信号完整性问题,重新改板  详情 回复 发表于 2017-5-31 15:37

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发表于 2017-5-27 14:39 | 只看该作者
1. 间距不满足3W(常规设计),绕线起的包太窄了。" c% W% [7 b5 \* o3 f$ |
2.阻抗不连续,走线在变压器下方,没有参考平面。
. q% X% ^' G6 J9 a3.常规地址线应该比数据线长的。

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发表于 2017-5-30 21:53 | 只看该作者
跑不起来要看看是速度上不去还是一点都跑不动,如果是一点都跑不动,,那就很有可能不是信号完整性问题。。看看硬件有没有问题,如果是速度上不去在去考虑干扰问题。

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刚问了硬件,具体是怎么跑不起来,他说就不知道怎么情况才解决不了!  详情 回复 发表于 2017-5-31 15:50
我只是单纯画板的,板子是硬件调的,你说的那些,我都不懂  详情 回复 发表于 2017-5-31 15:43

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发表于 2017-5-31 10:17 | 只看该作者
RJ45选自带变压器的,不要再额外加隔离变压器了

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 楼主| 发表于 2017-5-31 15:30 | 只看该作者
superlish 发表于 2017-5-26 18:28  L& A3 ?5 c0 S' T; s
这三根是否是需要等长的?你这里差的好大啊  (有PIN延时吗?? DDR2就用单端1根DQS,有要求全等长的,不知 ...
8 [/ i/ O% @7 v/ T, X8 ^
没有等长,你指的三条信号线是MDQS0,MDATA7和MDATA5.MDATA7和MDATA5是等长的( O# p+ F( t+ Z/ |
' a7 |' F1 M& l. M: z

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 楼主| 发表于 2017-5-31 15:37 | 只看该作者
ALLEGROPCB 发表于 2017-5-27 10:19, @  d* c/ c+ L9 Y, G8 {) k
你这个跑步起来很正常,一般时钟最长, 具体看芯片指南,有一些芯片,是数据线和时钟误差不能超过600. 。。 ...

/ u4 g0 q2 ~6 @6 y0 G2 x你好,不好意思,文件公司不让上传的!另外画的一个板子,数据也比时钟长,大概是在500MIL内,能跑起来,这个跑不起来的板子,结构有限制,板子太小,CLK时钟无法走比数据线长,现在怀疑是信号完整性问题,重新改板,到时看看能不能跑起来" f( T- n9 l; W4 L& S  r  y

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 楼主| 发表于 2017-5-31 15:43 | 只看该作者
jerryzhu 发表于 2017-5-30 21:53
+ x  ~& m: g: E跑不起来要看看是速度上不去还是一点都跑不动,如果是一点都跑不动,,那就很有可能不是信号完整性问题。。 ...
' }  b/ V( o4 S6 l1 ?% V
我只是单纯画板的,板子是硬件调的,你说的那些,我都不懂
( V; `& u  b9 u' H: B% Z

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 楼主| 发表于 2017-5-31 15:50 | 只看该作者
jerryzhu 发表于 2017-5-30 21:536 d$ [5 x& v) i7 {' U) A
跑不起来要看看是速度上不去还是一点都跑不动,如果是一点都跑不动,,那就很有可能不是信号完整性问题。。 ...
0 i. z- U. k5 Q. B' h4 {7 f4 Z; W
刚问了硬件,具体是怎么跑不起来,他说就不知道怎么情况才解决不了!7 w8 i, E8 ~; d
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