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[仿真讨论] [求助] ddr4 中的 data training 是什么意思

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发表于 2016-11-15 17:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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各位老大,
1 A7 p; W6 x4 I5 Y) E) p0 B5 K# P' f) S7 r8 g/ ]3 h0 f
    ddr4 中的 data training 是指什么, 看协议看糊涂了, 不是很理解.
4 F8 e# r8 d# Z3 P4 g% r6 _; O
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发表于 2016-12-9 07:42 来自手机 | 只看该作者
可以理解成数据信号的一个自适应接受的过程,ddr4的数据信号参考电平是不固定的,所以判决门限也不固定,在系统启动的时候就要自适应的去找这个门限,使得数据眼图最优化。

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发表于 2016-12-23 13:13 | 只看该作者
training是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。

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可以调delay的话那不是不用做等长了?  详情 回复 发表于 2017-1-13 15:11

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 楼主| 发表于 2017-1-13 15:11 | 只看该作者
ljzyhjbfwh 发表于 2016-12-23 13:13" s  K* ?; y, V, c  a7 M( O2 o
training是调整各种delay和Vref值,使得各种时序最优和数据的接受眼图位置最优。
  B( y4 R2 I2 G, @) X
可以调delay的话那不是不用做等长了?% o7 H% U1 T/ s4 j4 H

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等长还是需要做,内部调delay有个范围,超多了,就调不到align了。  详情 回复 发表于 2017-1-16 13:45

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发表于 2017-1-16 13:45 | 只看该作者
l888888h 发表于 2017-1-13 15:111 |) ^3 {) i  r# U" J4 [
可以调delay的话那不是不用做等长了?
6 Q$ j, W" O& J, X# i
等长还是需要做,内部调delay有个范围,超多了,就调不到align了。# U" I, f4 r" s- l

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内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?  详情 回复 发表于 2017-1-16 19:50

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 楼主| 发表于 2017-1-16 19:50 | 只看该作者
ljzyhjbfwh 发表于 2017-1-16 13:45
" q# J: o/ p2 b3 U0 P等长还是需要做,内部调delay有个范围,超多了,就调不到align了。
  n0 x* e# {% t& `6 V: Q* [+ A% n
内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?& {3 o2 Q6 P. i+ s% I

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协议上没有。  详情 回复 发表于 2017-1-17 14:02

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发表于 2017-1-17 14:02 | 只看该作者
l888888h 发表于 2017-1-16 19:50
9 ]! F8 \7 I6 C$ k. M/ g  r: k内部调delay的范围, 协议上有没有规定, 还是取决于芯片厂商?
. w& a: X, \* i7 o
协议上没有。! v: D) e& S9 \. }

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 楼主| 发表于 2017-1-18 19:00 | 只看该作者
了解, 谢了

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发表于 2017-3-18 10:14 | 只看该作者
有ddr4的文件吗?能不能分享下1145441303@qq.com,多谢
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