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[Cadence Sigrity] Allegro Sigrity OptimizePI Training(四)仿真优化结果查看

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发表于 2016-7-29 17:01 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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Allegro Sigrity OptimizePI Training(四)仿真优化结果查看

! k, R! h  x6 `& v; K
本文大纲
1. 去耦电容仿真设置(一)
2. 去耦电容仿真设置(二)
3. 去耦电容仿真设置(三)
4.仿真优化结果查看

. F& e5 c8 \( s$ |4 }; j" |+ f2 Q8 h  u! h- T+ U5 s# t; t* P
2 V( Z! k4 z. q* `! Q
关于OptimizePI
      去耦电容的优化需要综合考虑PDN的性能和成本因素,在目前的PCB或封装设计中,往往存在PDN电源噪声(包括低频和高频)超标、性能不满足设计、成本较高等问题。随着设计变得越来越复杂,电容的位置和容值选择往往大大超出设计人员的经验。
       OptimizePI提供业界第一个能够综合考虑电源PDN性能和成本的解决方案。OptimizePI使用专利的电磁分析和优化算法,可以快速、准确地进行电源分析,自动排列组合去耦电容的容值和位置,提供兼顾性能和成本的电容优化方案,根据优化的不同目标,帮助设计人员在成本、空间、数量和性能之间做出权衡。OptimizePI提供交互式的优化结果后处理,方便用户直观地选择优化结果

; Q' o6 w2 s( @& Z( j/ B# d! X: s5 _& }6 j
仿真优化结果查看7 W, J( F% W& C7 [1 j3 [
; R* k7 W7 j  u3 L
本模块用到的PCB案例:
1. 6层PCB设计,第2层是地平面、第5层是电源平面
2.1个电源网络:VCC(红色显示网络)
3.1个地网络:GND(绿色显示网络)
4.1个VRM、5个IC器件(阻抗观测点)、28个去耦电容
& ^! j5 ?1 x3 O* y/ q
2 T! W9 [9 q; [7 y4 B, p
- G' E7 i+ |& t, v+ R

* w* _' L9 n# f7 t
本模块中,我们将会用OptimizePI分析不同的电容滤波方案对几个IC器件的电源阻抗的影响,从OptimizePI推荐的方案中选择合适的方案优化PDN设计。
' }4 Y# O3 F5 L# p6 L7 ]
30. 在仿真结果区域上边的下拉列表中,选择All Observation and VRM Ports,显示所有观测点位置的阻抗。(没有修改的话,默认显示的是第一个观测点的阻抗)

" c/ A* {9 H9 q- G

! ^: ]- z/ M, q* B  Q
31. 在左边的电容方案列表中,用鼠标或者键盘的方向键,浏览不同的电容方案,在右边的窗口观察相应的综合性能、电容成本、阻抗曲线的变化情况。把鼠标悬停在电容方案列表区域,可以查看对应电容方案使用的电容类型和数量。
8 L# d' C- U6 R; ], D) h9 W$ X$ g+ @* e$ D
以Scheme 37为例,在性能vs成本曲线窗口,可以看到这个方案的PDN性能和电容成本都优于原始电容方案。在频域阻抗窗口,可以看到在100KHz-100MHz频段,这个方案的阻抗曲线比原始方案更平坦,平均阻抗也越小。
3 M. V& m6 v- e3 g7 R
( {( K* @/ Y8 y
32. 在Workflow中选择“Export Scheme Data”

3 ]) X: h; J& S' W7 W
7 q# A5 N- A2 L  ^, P! [. E5 S6 v8 |  W
在Scheme Data Export窗口,选择Scheme 37,输出这个方案的电容优化详细结果。Output Files勾选“SPD File”,输出电容优化后的spd文档,勾选“Placement Table for All Optimization Schemes”,输出所有方案的电容配置表格。点击OK确认。
" k5 |" |+ e' a2 U! r
& S- c' r0 p1 I& ~) _4 m$ y: [
在弹出的“Comment for BNP File”窗口输入注释信息,点击OK确认。

9 J7 x; z  o6 p* `# h$ f# w1 H
. t' s1 C+ V2 y( i
33. 查看D:\Training\Sigrity_OptimizePI\Lab\Module1\demo\目录下的输出文件如下。
demo_Device_Optimization_OptimumDefault_Scheme37_Decap_Report.txt:

; @6 @, D7 a3 h7 R- v/ N

; ], P. H( X) ?9 T0 J: B' [
demo_Device_Optimization_Placements.xls:

1 |$ w$ ]! H$ ?0 e1 @

7 R3 |( z. i8 ~8 {- D# }
34. 在Workflow中点击“Draw Capacitor Placement”,Color Map选择“Capacitor”,查看对应方案的电容分布。

0 f; q* T1 o2 w& M- a

% z  m5 _8 w+ k4 y% C: E4 ^0 E3 J3 u! z; W

7 k3 }. W" B4 w+ R5 R4 }
可以在色标条区域右键菜单选择用Log Scale或者Linear Scale显示电容容值。

2 J7 a9 J2 j+ s% o: i- D$ Q" n
1 e+ W" n8 R* p8 U
35. Color Map选择“Loop Inductance”,查看每个电容的fanout环路电感大小。

6 E" O' n2 t+ s& w% O, O
, T: m' y" e, ^/ ^( f. |) s
36. 在Workflow中点击“Create Report”,选择需要添加到报告中的内容,点击OK生成报告。
6 r4 y, L8 \+ C( _/ ^
% p, @7 w# Y! _% N. x

7 @' n$ {& |0 w1 S$ y. {( k. w5 i# P. D
37. 查看仿真报告内容如下。

4 {& ]' U0 g0 y0 r: w
5 E- w% P8 t( f* _9 i, f
  E  x+ j! D# N% B
9 O+ _. J* r8 d1 Q7 ~: o: O
! R9 w" x* {1 `

0 X" X7 C% T$ {) z% A2 n% ]3 j
38. 在菜单栏选择File->Save As(*.htm),保存仿真报告为“OptimizePI_Device_Optimization_Report.htm”。

" X3 ^; T. Z3 U/ u7 Z/ z

, i# }+ W1 T( f9 T9 L# |3 L
39. 点击软件右上角的图标 ,在弹出的对话框中选择保存并关闭软件。
. i0 m0 l3 o- N+ x- N
-----本文完----9 d( d% ~  k+ V3 m
/ K. q- v$ i2 E% b  V

4 j* Z7 z- O) t
9 |2 `1 o( {0 o) N% g: {
5 l, @/ o/ r! l: B+ D0 Y  |
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发表于 2016-8-16 17:34 | 只看该作者
学习了,非常欢迎版主基础性的文章,版主真的辛苦了,写了这么多教程,是我们这些初学者的福利呀。版主可以出书了。

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发表于 2016-9-7 16:21 | 只看该作者
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果然是神key!谢谢楼主分享!

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发表于 2016-9-18 14:18 | 只看该作者
受益匪浅,谢谢。

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发表于 2016-9-18 17:48 | 只看该作者
謝謝分享

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发表于 2016-12-8 16:30 | 只看该作者
厉害

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发表于 2017-2-9 16:35 | 只看该作者
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