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差分线与等长线

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发表于 2016-3-2 16:04 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问下pads中差分线与等长线有什么区别啊,又该怎样设置?求前辈赐教。0 T. f, T, V+ o. A' }6 Q8 Z' t
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发表于 2016-3-7 08:50 | 只看该作者
一、差分线9 M- t( [3 @  _* o

; D* S0 I& Y) {6 U1.差分线定义:' [0 e, j" ~5 j; _' P
差分信号就是就是驱动端发送两个等值、反相的信号,接收端通过比较这两个电压的差值来判断逻辑状态“0”还是“1”。
) m* Y, b8 q! ~而承载差分信号的那一对走线就称为差分走线。
' z1 x* |8 J: n9 m9 `
" d+ X  |6 f6 n6 A: S: T2.差分线的优势
+ w, Z3 a( k! h: n" _+ z: a差分信号和普通的单端信号走线相比,最明显的优势体现在以下三个方面:4 d; V, x" p6 P8 V

% L* w+ X$ a) c" k. {' Aa.抗干扰能力强,因为两根差分走线之间的耦合很好,当外界存在噪声干扰时,几乎是同时被耦合到两条
1 U, u$ C0 V; a线上,而接收端关心的只是两信号的差值,所以外界的共模噪声可以被完全抵消。8 n! \4 N/ b( E4 a" W) O
& B0 r* I7 [. C& W
b.能有效抑制EMI,同样的道理,由于两根信号的极性相反,他们对外辐射的电磁场可以相互抵消,耦合的越紧密,互相抵消的磁力线就越多。泄放到外界的电磁能量越少。
* ^) ~* y  v, z* t+ l3 o1 b/ e6 s
% r: A' }$ H% f1 Lc.时序定位精确,由于差分信号的开关变化是位于两个信号的交点,而不像普通单端信号依靠高低两个阈
8 i8 P; d$ c) t" e* v值电压判断,因而受工艺,温度的影响小,能降低时序上的误差,同时也更适合于低幅度信号的电路。9 S" R1 o8 o9 C* `3 q: ~

0 p5 S" t6 N# c) J. C; ~3.差分信号的布线要求:& Y$ H( R- ]6 ?4 y1 R% u( [
! L9 F/ y7 H3 w7 `" I, _
      简要的说差分信号的布线有两个要求:等长、等距。等长是指两条线的长度要尽量一样长,等长是为了保证两个差分信号时刻保持相反极性,减少共模分量;等距是指两线的间距(此间距由差分阻抗决定)要一直保持不变,也就是要保持平行。
" c9 G% W5 o9 S; G3 o3 Z6 Q( p0 B, X6 X& }6 }3 Y; t1 _1 ^* w+ N
      但是在实际的PCB布线中,往往不能够同时满足两个要求,比如说由于管脚分布,过孔,以及走线空间等因素存在,必须通过适当的绕线才能达到线长匹配的目的,但带来的结果必然是差分对的部分区域无法平行,不能满足等距的要求。
! W) l4 G5 N2 `# T3 p* b: \
% G5 h- v5 K5 H* K  Q3 e) B% a      因此,必须在这两个条件中设定优先级,哪个是必须保证,哪个是可以通融的。
4 Q1 B' n/ w7 e# |0 z# E% h) e
. X) P5 E; l8 H9 W! o1 t      满足等距要求的目的是保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性及时间延迟。其实间距不等造成的影响是微乎其微的,相比较而言,线长不匹配对时序的影响要大得多。再从理论分析来看,间距不一致虽然会导致差分阻抗发生变化,但因为差分对之间的耦合本身就不显著,所以阻抗变化范围也是很小的,通常在10%以内,只相当于一个过孔造成的反射,这对信号传输不会造成明显的影响。而线长一旦不匹配,除了时序上会发生偏移,还给差分信号中引入了共模的成分,降低信号的质量,增加了EMI。
" Y( u4 r8 |' _  r8 R; I& M* _( H  @2 E3 f) d% W+ V7 b
      因此,差分走线的设计中最重要的规则就是匹配线长,其次就是尽量满足两线平行走线。5 d, J( `. Y. z1 m; J
8 R7 l0 r) v5 T7 f- v/ r
二、等长线
+ z7 V2 o3 f+ ^5 v& Z9 w' O) I$ G7 o! T9 L
通俗点说,所以需要匹配线长的信号线都叫做等长线。
, W# t% Y* m- ~! G( B8 n, K
& Y) |) _% {0 N; Q如果差分线也需要等长的话,就叫做等长差分线。7 u4 I* C8 S6 z6 d1 c
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 楼主| 发表于 2016-3-8 14:34 来自手机 | 只看该作者
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