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设计好的PCB如何检查等长的问题

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发表于 2015-9-25 14:57 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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一个主IC挂两片DDR,主IC到DDR使用T型结构分出,要求是主IC分别到DDR的网络等长,设计的时候使用的是虚拟过孔,设计完成后如何检查符合要求。还有DDR3做等长200mil以内可以吗?+ ]1 m2 |. f3 S6 B2 g9 q* i
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发表于 2015-9-25 15:28 | 只看该作者
设计完成后输出等长表格后,检查等长数据。+ C& B* ^5 P+ v/ ~" [% ^4 b
: s4 O4 h1 Z% H1 A# V" X
地址线等长200mil没有问题。

点评

请问jimmy 输出等长表格是这个吗?  详情 回复 发表于 2015-9-25 23:13
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 楼主| 发表于 2015-9-25 23:13 | 只看该作者
jimmy 发表于 2015-9-25 15:28
1 ]/ H# O, [& L$ g' i6 e+ }1 g5 S( b) C设计完成后输出等长表格后,检查等长数据。
$ K' G6 f: k. S7 c; ]! h" \
; O2 n$ f4 j/ \  N( K0 k7 U9 I地址线等长200mil没有问题。
7 t. D8 w$ k) e
请问jimmy 输出等长表格是这个吗?
* q5 R" W+ Z& v

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发表于 2015-9-28 09:47 | 只看该作者
对,是的
; O8 w  U5 `2 ^8 w+ d. f4 I  q) Q7 v. X) N+ P( Q- L* P
详情可参阅《PADS9.5实战攻略与高速PCB》一书。
  k- y* B; x# K& |; C
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发表于 2015-10-5 10:27 | 只看该作者
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