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[仿真讨论] 求PCIe3.0 插损和回损的参考标准

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发表于 2014-11-20 16:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如题:求PCIe3.0 插损和回损的参考标准
% k0 ?. {5 v' W! w哪位大师可以给参考资料
/ X/ c0 g  I5 {( w! r; E* D+ y
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发表于 2015-11-7 22:10 | 只看该作者
Quantum_ 发表于 2015-11-3 15:02
  j' K+ v4 y9 ~: p7 o我公司的某PCBA 发到 I....公司做测试。" X2 Q' |1 ]6 W. k! X8 C
他们反馈的信息是. 8 @) v! n9 {8 S0 }% d/ E
--Find a problem during return loss tes ...
8 \# @" V1 m+ J9 P
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?; n0 q' U+ U3 c
Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。
( V" K: M+ \: F5 C& s3 u# S% s+ U2 ^: H, `' v9 b) l: Q& l" l
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!
4 d' w8 r3 y; iRL测量时通道的频域测量,而眼图是时域测量。不是说RL不过眼图就一定会很差,RL不过只能说明通道存在不连续问题,导致信号在某些频点上的反射比较大,能量不能很好的从发送端传输到接收端,而眼图是时域测量结果,这个结果不仅仅包括频域上的RL,也跟频域的IL和编码以及热噪声等很多因素相关,并且眼图还可有均衡等方式。所以说不是简单的认为眼图完美,其他的结果就一定都是Pass的。9 u9 K% s' S# a- x

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发表于 2014-11-22 09:36 | 只看该作者
先参考协议
. q& z. `( x4 y再根据走线长度来定,关键还是接收端可接受level
新年伊始,稳中求胜

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 楼主| 发表于 2014-11-26 15:08 | 只看该作者
cousins 发表于 2014-11-22 09:36- u9 V3 a) [' A
先参考协议
3 D+ j: |! A1 B! m再根据走线长度来定,关键还是接收端可接受level
! @+ }* W' l* f$ O0 T2 B0 K
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到无源通道的标准,无源通道不是能够说明整个链路的损耗情况吗,如果满足一定的标准,而且我的发送和接收都满足PCIe标准是不是就ok的,PCIe2.0有PCIe3.0没有,

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发表于 2014-12-5 23:03 | 只看该作者
shirley_zong 发表于 2014-11-26 15:080 S# ]1 Y: p- t
虽然每个接收端可接受的level不一样,是不是都会满足PCIe协议呢,在协议上能找到眼图的标准,但是找不到 ...
( y1 E& Y2 s: [5 I  ^
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕量就会比较大,如果EQ能力比较弱,那么对PCB的设计就要求比较高。在Intel的PDG里面,从Host到Receiver的Total length,你可以根据这个去设计你的物理通道。PCIE的specification只有Gen1有对IL进行规定,Gen2和Gen3都不对IL做规定,所以各位在设计物理通道时需要根据EQ能力做相应的调整。
$ v. h9 E* y1 a: J5 U% w

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那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?  详情 回复 发表于 2015-10-31 23:36

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 楼主| 发表于 2014-12-18 10:15 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:038 E4 C1 w$ N/ J% K6 [0 ?2 J
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
* z* b2 |. z4 |# ]
我知道PDG中呀长度,但是我们的设计师OOG的,所以添加retimer,想带retimer仿真,现在还无从下手,所以想看看频域上面的情况  Y& I: P) g5 y0 I* `7 O' u9 |/ c4 J

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发表于 2015-10-31 23:36 | 只看该作者
Coziness_yang 发表于 2014-12-5 23:039 q' r( P/ _8 K, }; _0 `" E& a
因为PCIE3.0里面有EQ,EQ的能力有强弱之分,有些Host或者Receiver的EQ能力比较强,那么留给物理通道的裕 ...
1 A  K" s, m- i" v5 \1 c
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
/ o3 E! m3 h1 w8 P1 b6 u6 A) K

点评

建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。  详情 回复 发表于 2015-11-1 10:32

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发表于 2015-11-1 10:32 | 只看该作者
964008794 发表于 2015-10-31 23:36& ]3 Y, e- J1 V1 b% `- E9 a: l
那还有必要做PCIE通道的无源仿真吗?如果做的话,应该以什么为参考?
6 s$ o3 L2 r# C, e6 r
建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有限,所以建议进行仿真,了解通道的特性,便于我们分析。还有就是需要知道通道的loss情况来调整EQ的参数。

点评

我公司的某PCBA 发到 I....公司做测试。 他们反馈的信息是. --Find a problem during return loss test on T..3 connectors. 此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的  详情 回复 发表于 2015-11-3 15:02

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发表于 2015-11-3 15:02 | 只看该作者
Coziness_yang 发表于 2015-11-1 10:32
: t& G9 x3 C9 Q, m* U建议进行仿真。因为EYE关掉的原因不全部是loss造成的,有些可能是Jitter过大,而EQ对Jitter的补偿能力有 ...

& j1 v+ V( E9 W' O* ~7 w0 `9 s/ D我公司的某PCBA 发到 I....公司做测试。
1 R0 b3 p' k. B. z/ O7 N他们反馈的信息是. $ x1 E- k! p' [1 C' p0 m
--Find a problem during return loss test on T..3 connectors. * ]# E- [  R- D1 e* ^9 v' E! ?/ P* J
此项目, 在我公司内部, 有做完整的眼图测试(不只是仿真)。 而且眼图报告,挺好的。 # t( L8 ?+ _# T" j  T5 h
我的问题是:' i" Q$ U4 }) s
1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备?. @0 U/ r' d6 G7 A3 K4 R
2. 有点迷糊了, 难道眼图的模版里, 不包涵Return lost 的参数吗?换句话说, return loss faill, 我的眼图还可以很完美?感觉怪怪的!!!! A" ^# c9 X  ^. I/ J5 w# ]) W

' R7 T. G9 G; i3 Y. @* Y
  c3 F2 m* ~2 P2 r8 g, C" G, O3 k6 m$ C9 x) H" N# I& l" }3 _7 R& _

点评

1. 为何, I....公司单独做一个 return loss test? 他们用的是什么方法?什么设备? Return Loss用VNA(矢量网络分析仪)就可以测量,测量RL可以反映通道阻抗不连续的程度。 2. 有点迷糊了, 难道眼图的模版里,  详情 回复 发表于 2015-11-7 22:10
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