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高速数字系统设计——源同步时钟的疑问

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    组图打开中,请稍候......
发布时间: 2014-4-17 16:45

正文摘要:

如题,在源同步时钟中,他的保持时间,如图所示,明显感觉其hold时间的计算应该是加上Tpcb_skew的,是不是我理解有问题。

回复

格林杨 发表于 2014-4-21 11:02
0aijiuaile 发表于 2014-4-20 08:27
+ M5 y% I: T! h- J! q6 ?是的,但实际绕线一般不会做正偏差的,有可能PCB做正负偏差,因此此处裕量还会是减号。从公式来说,你 ...

* A& Z7 j7 @4 R" x$ e4 b+ I了解了,感谢
0aijiuaile 发表于 2014-4-20 08:27
格林杨 发表于 2014-4-18 11:31. q. l( A* i- G7 o$ ~6 c
应该是Thold_margin=Tva-Thold+Tpcb_skew对吧
4 L+ r& V* L9 p1 Q- p  R1 H. i3 V
9 {+ @% E7 ^2 t& T
是的,但实际绕线一般不会做正偏差的,有可能PCB做正负偏差,因此此处裕量还会是减号。从公式来说,你是对的。
格林杨 发表于 2014-4-18 11:31
ZM218wri 发表于 2014-4-17 23:53
+ h, h6 E5 m1 O# r7 J5 ]已经含在表达式中了

' d# T4 }. C) P( m% r应该是Thold_margin=Tva-Thold+Tpcb_skew对吧
格林杨 发表于 2014-4-18 11:27
0aijiuaile 发表于 2014-4-17 22:25
8 N+ s& E6 e7 g0 Zyou are right

$ N+ E8 D  u& o7 e) n+ q7 Chold margin 时间计算错误是吧。
ZM218wri 发表于 2014-4-17 23:53
已经含在表达式中了
0aijiuaile 发表于 2014-4-17 22:25
you are right
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