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【原创】理性认识SQ的时序仿真功能（不断更新中）_如需转载，请务必征得作者同意

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forevercgh

发布时间: 2008-4-24 09:58

正文摘要:

SQ所谓的时序仿真功能事实上是在一个测量和套用公式的过程。, L/ j) Q; Y" l) i+ }' t9 V （想起allen版主的一句话：会用软件不代表什么，理解软件的工作原理才是正道----软件中计算的理论基础） 6 c- R) I$ M- e5 ...

cousins 发表于 2014-1-16 17:31

hugeme 发表于 2013-12-16 16:06& \( p+ i7 O; z, O4 }( }
问下，如果我们直接使用IBIS模型，外接测试负载，测量电压到VMEANS的时间是得到的bufferdelay还是得到的 ...

不要抓Vmeans
抓Vthreshold
timing 应该以读AC threshold和DCthreshold为准
通常是包含了TCO的，具体你可以咨询供应商
况且你再设计的时候一定会保证建立裕量和保持裕量，TCO通常是不会大于整体skew的

hero1380 发表于 2014-5-4 17:19

forevercgh 发表于 2008-5-20 12:37, C, p5 k# t W2 G
需要罗嗦一个问题，所有的参数的采样点都是pin，而不是die（大家基本都在使用的可不是裸片，没法die上直接 ...

如果说所有的参数的采样点都是pin，而不是die，对于测试来说是方便了，可是和allergo定义的first switch/settle time貌似die啊，如果是pin，那应该是对应图中红圈中的点，不知道我说的对不对。

rise1.png (112.6 KB, 下载次数: 4)

hugeme 发表于 2013-12-16 16:06

forevercgh 发表于 2008-4-24 10:38
/ {8 P+ v' K' P1 X兵马未动，粮草先行。' L& d- L; a' X5 Z
先从时序分析的一些概念入手。
3 G- ?7 a& P$ k- U) v7 v8 i

问下，如果我们直接使用IBIS模型，外接测试负载，测量电压到VMEANS的时间是得到的bufferdelay还是得到的就是包含logic delay的TCO呢？

dengbaba 发表于 2016-8-19 13:33

带板凳学习

hugowong 发表于 2016-5-19 23:20

学习学习

denianzhang 发表于 2016-5-9 19:47

谢谢分享！

dengbaba 发表于 2016-3-30 08:46

版主神人

brady.lu 发表于 2015-12-25 14:45

学习下........

风过了无痕 发表于 2015-12-11 11:30

不错的贴，学习中

guji 发表于 2015-12-7 16:47

感谢楼主,学习

:):):):):):):):):):):):):):):)

guji 发表于 2015-12-7 16:47

感谢楼主,学习

guji 发表于 2015-12-7 16:47

感谢楼主

:):):):):):)

guji 发表于 2015-12-7 16:47

感谢楼主

chinest2010 发表于 2015-11-22 11:06

说得好！

江岸听潮 发表于 2015-10-19 20:24

看完，可惜没有后续跟进，有没有相关资料可以推荐下？

bashao 发表于 2015-9-23 22:59

感谢楼主理论知识的补充

terry_yung 发表于 2015-9-18 16:44

时钟和数据对测试负载验证TCO输出完全同步的根本没延时

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