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ddr2的数据线波形，高手指点

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cwfang

发布时间: 2010-5-26 14:41

正文摘要:

本帖最后由 cwfang 于 2010-5-26 14:42 编辑 ; h$ V, L- S) |: n/ ] % D0 e ~: u# S2 t 以下是我仿真出来的ddr2的其中一根数据线的波形，不知道有没有问题，怎么判断？希望高手指点一下。还有hyperlyn ...

hardy 发表于 2013-8-31 18:20

jason_pa 发表于 2011-3-29 22:17' q* J9 f5 [' B9 Y: i) M0 J
仿真总线，还可以通过在boardsim中将走线按照s参数提取，然后在line-sim中调用s参数即可
! h* [6 T' V! D. l比较过，差异较小 ...

大神你分析的听不懂做培训不我想学

qq137098502 发表于 2014-8-26 16:13

我觉得仿总线就是看下串扰吧，就数据线来说楼主的结果很不错了，数据线看电平，时钟线看边沿，数据线的电平时间窗口留的足够了，没有过冲和振铃，就行了啊。

abc999888 发表于 2013-11-6 13:16

DDR 不是集成了,用过DDR 向导，就可以对DDr 的读写时序仿真.

zxyamy 发表于 2015-2-3 17:11

学习了！

Colin_SI/PI 发表于 2015-2-3 16:17

对照手册或者JEDEC标准中的DC和AC特性图判断！！！

jxyggg 发表于 2014-12-31 17:15

学习了

areslee 发表于 2014-11-24 19:03

学习了，记号

xie0110 发表于 2014-11-11 22:47

对照手册或者JEDEC标准中的DC和AC特性图判断

草草 发表于 2013-12-25 15:48

记号！留着用

yn_heyg 发表于 2012-1-31 15:28

学习一下。

YHGDPCB 发表于 2011-8-26 13:20

敢问楼主你这个DDR的控制器模型哪里找的

FLP15 发表于 2011-4-22 10:08

学习

jason_pa 发表于 2011-3-29 22:19

另外，发现hyperlynx也不能进行总线的串扰后仿真分析

jason_pa 发表于 2011-3-29 22:17

仿真总线，还可以通过在boardsim中将走线按照s参数提取，然后在line-sim中调用s参数即可
比较过，差异较小
但是hyperlynx不便于进行时序仿真，比如仿真自动计算的min/max flight-time等均不正确，特别是max完全错误；此外因为没有flyby的波形，也不利于手工测量flytime的时间，只能大约评估，对于高速率，是无法保证精度的

相约鹏城|11.15-19高交会X慕尼黑华南电子展X华南电路板博览会X半导体显示展: 高交会 - 智能制造、慕尼黑华南电子展、慕尼黑华南电子生产设备展、华南先进激光及加工应用技术展览会、华南电路板国际贸易采购博览会、机器视觉展暨机器视觉技术及工业应用研讨会，将于2022年11月15日-17日在深圳国际会展中心（宝安新馆）举办，展会立足粤港澳大湾区，辐射华南、西南及东南亚市场，为经济复苏献力。

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