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关于端接的一个问题

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发布时间: 2018-5-8 17:32

正文摘要:

( v/ c* P+ V: @4 `+ T* z如图所示 5 X' T/ d6 Y$ Y1 r9 N% }& D1.实测在端接电阻R1为0R时,AB两点的波形都是图①的情况,有些过冲' q" q) z, v  o% w  a! O$ c3 l 2.在调整端接电阻为100 ...

回复

Joen0_0 发表于 2018-5-13 20:45
kobeismygod 发表于 2018-5-13 16:54, a  V; h/ `$ O' O8 y9 i) W0 E( m
串联端接主要用于输出阻抗小于走线的特性阻抗的情况,这个电阻目的是增加了源端的输出阻抗,所以在图上电阻 ...

, W+ F% ^. r8 T; D% _了解,我只是觉得说
' S) H+ \! L$ r( u7 \4 L1.电阻已经很靠近源端了,还是能测到电阻到源端信号的过冲现象,那是不是说,端接电阻不管怎么放置,源端到端接电阻一定还会有过冲的现象. w% v6 g) y! l- i' z
2.端接电阻到源端的距离影响着这个过冲程度(假如端接电阻就在源端BGA底下,是不是说,源端到端接电阻这段信号的过冲会变得非常小?)& h: m6 ]5 `0 K6 R( T0 W, `
3.虽然源端到端接电阻这段信号确实不是特别重要,这个产品也在出货了,只是我个人想通过交流学习一下知识
! ^3 y. N+ M& q% ~+ ~2 a4.真的非常感谢每一位大神,每次在365上问问题都有挺多人来回答的,真的感谢9 U4 n1 `% Z1 ?5 O5 r

点评

是的,端接电阻都是建议尽可能靠近输出端的,所以现在有些高速的总线的端接都已经做到片上了。但是不管你的端接电阻摆放的多么靠近输出,只要阻抗出现不连续,就会有反射存在。  详情 回复 发表于 2018-5-14 12:39
ABCDJ 发表于 2018-5-25 19:30
we167527 发表于 2018-5-23 19:29
# s5 \" G: D) g' S0 N9 O末端端接意思是。像在地址线上那样并联一个上拉?还是在最末端像VTT那样?
! ~: B, v% H0 E% q7 f1 ]
应该末端像VTT那样,也最简单的方式也就是上下拉,阻值跟特征阻抗一样,单端和差分有点区别。但是直接上下拉会提升很多功耗,所以又有优化的版本,比如加电容的方式,而又因为输出IO一般驱动能力有限,这个电容容值很难选择。总之,对于单端信号的末端端接,基本上很少用,除非像DDR一样有个比较合适的VTT电源。
6 t3 H' H: ~, j' Y! V
kobeismygod 发表于 2018-5-17 16:03
we167527 发表于 2018-5-17 10:17
7 L4 p/ |$ r' C' `( }那我有个问题!5 R& Q& [! Y9 u4 C
就是DDR的地址组/控制组的那些匹配电阻为啥是需要靠近DDR颗粒摆放呢?

9 G& i$ M- Q3 a3 n* z7 i0 W; d因为这些信号线是单向传输,另外你说的这些信号用的是并联端接(我说的端接靠近输出端指的是源端匹配),也就是传输线阻抗小于输入端阻抗,所以并联端接电阻会接收端的等效阻抗降低与走线阻抗匹配,综上,需要靠近颗粒端摆放。. L+ ?2 z5 E* \- m3 ]2 @4 `$ }; \

7 Q, J& V( ^) N) Z2 \" X1 `1 @$ S

点评

如果地址线和控制线采用的是串联端接呢?应该放在何处?  详情 回复 发表于 2018-5-23 19:27
飞熊在天 发表于 2018-7-6 18:26
你的测量没问题,具体为什么,推荐阅读于博士的信号完整性手记中第四章:信号的反射与端接。
wuyatao 发表于 2018-6-27 14:29
:victory::victory::victory::victory:
we167527 发表于 2018-5-23 19:29
ABCDJ 发表于 2018-5-22 11:53& N) V: g7 b8 h' l
端接有很多种形式,源端一般是串联电阻,末端一般是并联,末端端接效果比源端好但结构复杂、功耗大,各有各 ...
" i( G, H0 q1 }$ E
末端端接意思是。像在地址线上那样并联一个上拉?还是在最末端像VTT那样?1 Z3 S  ~' r4 C0 j& ]

点评

应该末端像VTT那样,也最简单的方式也就是上下拉,阻值跟特征阻抗一样,单端和差分有点区别。但是直接上下拉会提升很多功耗,所以又有优化的版本,比如加电容的方式,而又因为输出IO一般驱动能力有限,这个电容容值  详情 回复 发表于 2018-5-25 19:30
we167527 发表于 2018-5-23 19:27
kobeismygod 发表于 2018-5-17 16:03
1 ?8 n+ _+ Z3 v5 I- y9 R因为这些信号线是单向传输,另外你说的这些信号用的是并联端接(我说的端接靠近输出端指的是源端匹配), ...
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如果地址线和控制线采用的是串联端接呢?应该放在何处?
) \6 i, B3 b0 X: |7 [
ABCDJ 发表于 2018-5-22 11:53
端接有很多种形式,源端一般是串联电阻,末端一般是并联,末端端接效果比源端好但结构复杂、功耗大,各有各的优势。但是对于高速信号和DDR等要求高的场合,都采用的是末端端接。

点评

末端端接意思是。像在地址线上那样并联一个上拉?还是在最末端像VTT那样?  详情 回复 发表于 2018-5-23 19:29
we167527 发表于 2018-5-17 10:17
kobeismygod 发表于 2018-5-14 12:39
" f5 e# c. g2 o2 m$ T5 D$ W0 V是的,端接电阻都是建议尽可能靠近输出端的,所以现在有些高速的总线的端接都已经做到片上了。但是不管你 ...
. ^; W1 N" C& N! @4 ~0 Y
那我有个问题!" x- B( ~/ ]$ R% g& [
就是DDR的地址组/控制组的那些匹配电阻为啥是需要靠近DDR颗粒摆放呢?
; Y7 ]$ p4 v6 }5 I' x% ?

点评

因为这些信号线是单向传输,另外你说的这些信号用的是并联端接(我说的端接靠近输出端指的是源端匹配),也就是传输线阻抗小于输入端阻抗,所以并联端接电阻会接收端的等效阻抗降低与走线阻抗匹配,综上,需要靠近颗  详情 回复 发表于 2018-5-17 16:03
Joen0_0 发表于 2018-5-14 22:42
kobeismygod 发表于 2018-5-14 12:399 S/ ?9 C/ |' a+ Z# [) V
是的,端接电阻都是建议尽可能靠近输出端的,所以现在有些高速的总线的端接都已经做到片上了。但是不管你 ...
' G& }+ U$ \' U# z. d- G; t6 N
嗯嗯,感谢
+ R) v9 y7 K& t2 i* s) z) q& E. r
kobeismygod 发表于 2018-5-14 12:39
Joen0_0 发表于 2018-5-13 20:45/ L9 m: F2 x0 P6 J8 h* l9 C! X
了解,我只是觉得说( r+ K8 I8 _2 Y' h- A* E9 `
1.电阻已经很靠近源端了,还是能测到电阻到源端信号的过冲现象,那是不是说,端接电 ...

3 ?: V2 o# }3 {( J- O. c是的,端接电阻都是建议尽可能靠近输出端的,所以现在有些高速的总线的端接都已经做到片上了。但是不管你的端接电阻摆放的多么靠近输出,只要阻抗出现不连续,就会有反射存在。
9 p7 J) y8 u5 A+ Q- G3 F8 e# e( f: y6 U* m% |, f

点评

那我有个问题! 就是DDR的地址组/控制组的那些匹配电阻为啥是需要靠近DDR颗粒摆放呢?  详情 回复 发表于 2018-5-17 10:17
嗯嗯,感谢  详情 回复 发表于 2018-5-14 22:42
哈士奇的主人 发表于 2018-5-14 09:06
qiantan 发表于 2018-5-13 22:07
* A$ O' y- }' D' I" h5 Y7 G那请大神讲讲,是不是所有的端接都是靠近源端比较好呢?

* k! [# s- c/ Q8 N6 b0 d不是,看具体芯片具体引脚的
# W  M/ Z" G2 {7 z5 t) l6 v
qiantan 发表于 2018-5-13 22:07
那请大神讲讲,是不是所有的端接都是靠近源端比较好呢?

点评

不是,看具体芯片具体引脚的  详情 回复 发表于 2018-5-14 09:06
Joen0_0 发表于 2018-5-13 20:37
哈士奇的主人 发表于 2018-5-10 17:38. m9 ?' a0 k, g7 g7 I) z3 K" Z! m
我们关心的是接收端的信号,接收端的信号质量好就行。这是pin to pin的走线吗?

/ g: w3 p, G# T是的,pin to pin+ a1 o* @5 X1 E5 F9 f7 P) W) E
你这个问题倒启发了我,要是一对多的话,结果又是如何。。。
9 g$ z4 H+ y" O" |, X1 w$ }! \2 O
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