第一个问题，我也比较疑惑
3 I0 A( x* f$ V& L3 _8 K4 Z% \; P4 Q第二个问题，我可以大致说下我的理解，对于高速信号而言，回流必须找阻抗最小的路径，而高速信号的阻抗主要表现为感抗，感抗和电感的大小有关，电感和磁通量有关，最后就是和回流面积有关，第一幅图的回流面积非常的大，而如果在信号的正下方，回流面积会很小

# h) I" z7 p. A( s/ XSMSC 的 Layout Design Guide 是這麼做的沒錯！
6 t1 E" j0 j( b4 c7 n
大哥英明神武、莊敬自強、處變不驚、慎謀能斷、三顧茅廬、三戰呂布、七出祁山、七擒孟獲……
9 j& i$ v4 m% R9 c9 \5 y$ ~2 t
4 {" S6 _$ l$ L# M" t  P, F( k* W我中華民族之復興指日可待！
, E% N" T* ^/ A$ j/ }" ~$ W

以下小弟我個人淺見
$ k* R/ X8 ^: ^* }$ h$ H如同上面大大所說的 高頻是看電感阻抗 在低頻才是看電阻阻抗
) C2 R: P+ T* e8 B( d影響電感很重要的因素是電流所走的迴路
2 I  y; {$ ?2 N- Q+ f6 o. [* I* kL=磁通量(正比面積)/電流
在相同電流下如果走訊號線下方可以發現電流迴路所產生的面積只有板厚乘路徑長度
而如果迴流走像DC那種路徑等於增加一段路徑而增加面積
/ x( n. m8 X3 {用下圖(Top View)來說明兩種迴流方式所包圍的面積
+ D1 k0 t/ U4 V; f
1.High Frequency Return Path
) i0 j. c, L: O  l' g$ `# V: B- V  D|--------------------|
|                       |
9 P- U& w* I/ X|                       |
                  
2.Low Frequency Return Path (<<<低頻迴流路徑)
, U/ c7 _' V# y6 _+ Y, W2 i|--------------------|
|                       |
6 B. y) F4 y7 T; `7 K/ K|<<<<<<<<<<|
) t5 D1 L- g4 Y( X6 J( c+ u
/ p/ W7 K; r0 A: u& k! m$ K可以發現低頻迴流路徑(上圖2.)會有比較大的面積
" Y( `, C6 ?, g* n6 X6 ?5 J# h# Y因此高頻走低電感的路徑必須走上圖1.的方式
! M6 b5 w& E8 w0 A; y
小弟為新人硬件工程師如有誤還請各位大大指正

学习啦

学习啦

学习啦

刚看了一份很不错的design guide

学习学习学习

关注下啦

我要下，没威望了怎么整

这种帖子回复量都这么少，不科学

阻抗最小的路径；磁通量最小的路径

超級狗 发表于 2017-10-20 11:32
老實說，這個問題也不算太爛，我需要再懸賞五兩銀給那個 A 版主來賺嗎？

哈哈，我以为有特殊要求呢，我是小白，见谅啊
; ~1 E( f8 Z. V, M  f9 n

AD9_PCB 发表于 2017-10-20 10:27
! P$ r- X" [8 w" C- P7 K/ @3 L3 m为什么HS走线和ss走线不在同一层

老實說，這個問題也不算太爛，我需要再懸賞五兩銀給那個 A 版主來賺嗎？
& C& j, i4 E& u4 h  f
. Q' e; m* N- s9 m5 l: B
1 U  f/ \6 b) L% V4 {9 v
貼圖看不出在哪一層，附上 SMSC Design Guide 上的一句話。

2 O' p  r5 f& @Route SS traces on outer layers, rather than on inner layers.
  W/ W/ o0 ?/ t1 S1 D( A
! l  S* y8 w" r9 k" ?
% Q: E" A3 V' _" x( o

超級狗 发表于 2017-9-30 10:24
/ n' E2 Y% |/ \* I. A& O/ USMSC 的 Layout Design Guide 是這麼做的沒錯！
; Q8 z+ p3 Y9 \! J4 [, ]( A
+ T( U# N) U( v1 w2 X  w2 V: k( i大哥英明神武、莊敬自強、處變不驚、慎謀能斷、三顧茅廬 ...

' c) J- a, ~! e为什么HS走线和ss走线不在同一层

C:\Users\Administrator\Desktop\yybb.jpg

学习学习