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CLK与DQS要等长吗?

查看数: 381 | 评论数: 7 | 收藏 1
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发布时间: 2017-5-19 10:37

正文摘要:

本帖最后由 NIWO99 于 2017-5-19 11:24 编辑 & b! T: E: I* a% l$ A # l. e6 {0 q. [; N$ p 大家来说说CLK与DQS要等长吗? 有的说DQS不能比时钟长,有的说DQS不能比时钟短,我现在有点晕了,上来问问懂的人。 . A ...

回复

eleven_ip 发表于 2017-5-23 09:54
superlish 发表于 2017-5-19 14:17: M; K. l0 L( h3 B
一般不做要求的吧
! s% s6 }; H( G3 U7 o你看你的芯片是否有要求??
. e* ]4 T8 `3 L, X" _8 b3 n  P
可以设的,DQS以CLK为基准,在-3500到500之间,可以这样设置,Delta=-1500,Tolerance=2000,即可满足要求。# m% X1 Z" n) p  h# l) j
渐行渐远渐无书 发表于 2017-6-8 11:46
看有没有自动调节功能
melody55555 发表于 2017-5-19 15:45
一般情况下,CLK与DQS不用等长
superlish 发表于 2017-5-19 14:17
本帖最后由 superlish 于 2017-5-19 14:30 编辑 - G0 ^3 ~9 k/ U" i* M+ P  w' A
3 G+ L7 q& d; G
一般不做要求的吧
+ Z7 N/ f0 m9 r! ?% T* S3 a$ K你看你的芯片是否有要求??
0 ~: S% f; i  H( [8 |. M: I" H# h& g* e
Delta 变量增量   TOlerance 误差 是+-的
, M' S7 M! N0 m- E; ^3 y, u另外觉得楼主你的TARGET选择有问题?你到底是要长还是短啊? ?
3 W2 l2 H2 H& o像这种范围这么大的,一个网络(差分时钟对内等长可以当做一个网络)不是在正区间,就是在负区间,找到目标线,让他最长或者最短范围内就好了,然后看情况绕如果长,那就设置长500的,如果短就设置3500内的  ,不可能两边都占的
9 e' V; k, x2 w. g9 w
: I+ y6 S( J$ W" u2 ^

点评

可以设的,DQS以CLK为基准,在-3500到500之间,可以这样设置,Delta=-1500,Tolerance=2000,即可满足要求。  详情 回复 发表于 2017-5-23 09:54
设计规范上有这样一个要求。所以我做规则时也想做这种两边兼顾的。好像是不能实现。 [attachimg]127103[/attachimg]  详情 回复 发表于 2017-5-19 17:23
ms642799785 发表于 2017-5-19 13:22
不需要
NIWO99 发表于 2017-5-19 10:38
欢迎讨论
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