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Sigirty仿真的目标阻抗为什么刚开始特别大?

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发表于 2017-2-24 10:43 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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各位大神:Sigirty仿真的目标阻抗为什么会出现椭圆部分?/ p/ R- w# y+ b* m

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发表于 2017-3-27 13:42 | 只看该作者
电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效

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vrm加上了 但我怀疑软件是不是没有读取?  详情 回复 发表于 2017-3-27 15:34

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 楼主| 发表于 2017-3-27 15:34 | 只看该作者
icy88 发表于 2017-3-27 13:42( c1 }0 q! _6 l5 P# H4 s8 R7 R
电源芯片那边没有加VRAM模型吧,通常用一个小的电阻等效
" _5 `# Q# ?/ r1 K: B
vrm加上了 但我怀疑软件是不是没有读取?2 A& S" j( a$ @* g& }+ n7 L

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那你查下,电源通路中其他地方有开路的地方,如中间的串接电阻,电感之类的没有赋值  详情 回复 发表于 2017-3-28 10:10

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发表于 2017-3-28 10:10 | 只看该作者
JLP7878 发表于 2017-3-27 15:34
8 |! c; O6 h$ g. y3 evrm加上了 但我怀疑软件是不是没有读取?
( ~3 i+ U$ U2 v: S/ z+ z: F8 c
那你查下,电源通路中其他地方有开路的地方,如中间的串接电阻,电感之类的没有赋值2 W. h: V4 `. ~6 {- d. B& T" Z) s

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发表于 2017-3-31 21:23 | 只看该作者
做PDS阻抗仿真需要做到几百MHz吗?我看intel Romley手册,PCB板级去耦设计只需关注1~2MHz就可以了

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看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m或200m之前,再大板级去耦就发挥不出效果了  详情 回复 发表于 2017-3-31 15:54

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发表于 2017-3-31 15:54 | 只看该作者
DaiXL 发表于 2017-3-31 21:23' u/ h9 L3 e' t: A5 O4 c! F
做PDS阻抗仿真需要做到几百MHz吗?我看intel Romley手册,PCB板级去耦设计只需关注1~2MHz就可以了
, K: c' N. B$ u( }: {; O, q
看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m或200m之前,再大板级去耦就发挥不出效果了

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板级去耦需要做到100~200MHz?这么高,我一般都是做到几十M  详情 回复 发表于 2018-4-9 17:40

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发表于 2017-6-28 19:11 | 只看该作者
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发表于 2017-7-5 00:36 | 只看该作者
低频不用管,只需关注20~100M就好,VRM短路,低频就很低

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发表于 2017-7-21 15:23 | 只看该作者
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发表于 2018-4-9 17:40 | 只看该作者
icy88 发表于 2017-3-31 15:54; ^' q! v9 a% x8 E4 a- F+ A
看芯片,有的片内去耦做的比较好,板上去耦就很轻松,但是有的厂家没有说明,通常业内默认板上去耦在100m ...

( ?4 y2 f* ]  L) N8 g板级去耦需要做到100~200MHz?这么高,我一般都是做到几十M7 U$ `8 p5 e. l$ B

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发表于 2018-5-14 10:27 | 只看该作者
阻抗不匹配

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发表于 2018-5-14 10:27 | 只看该作者
阻抗不匹配
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