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EDA365电子工程师网»技术社区 › 电子技术社区 › Allegro&Orcad PCB论坛 › 导入新网表后差分对变了

导入新网表后差分对变了

查看数: 156 | 评论数: 8 | 收藏 0
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Lora
发布时间: 2016-12-19 16:15

正文摘要:

本帖最后由 Lora 于 2016-12-19 16:25 编辑 " b* j$ C5 i2 c: q2 f7 J7 ~9 @- @! X" R , |$ N4 @2 p; [6 t! ~% Z6 S原理图就改了两个pin的引脚定义，PCB editor 中导入新网表后，规则里设置的差分对有些变了，是 ...

回复

zuoanwind 发表于 2016-12-23 11:19
xxlljj 发表于 2016-12-22 11:33& u" ^- v4 K. F7 r
记得PCB里的约束条件是可以导出的，你试试先导出再导入呢
$ }7 |' u0 _  \1 j; I. M4 i& ~
这个好
) r$ ?$ n& Z" e/ i
Lora 发表于 2016-12-23 09:47
xxlljj 发表于 2016-12-22 11:33! g- h! M- M( n7 O8 A. n% C8 A
记得PCB里的约束条件是可以导出的，你试试先导出再导入呢

5 `# ]+ q( ^& L+ g# V0 _7 ]8 R+ @- ^  N试了下，真的可以，感谢感谢
xxlljj 发表于 2016-12-22 11:33
记得PCB里的约束条件是可以导出的，你试试先导出再导入呢

点评

zuoanwind
这个好  详情 回复 发表于 2016-12-23 11:19
Lora
试了下，真的可以，感谢感谢  详情 回复 发表于 2016-12-23 09:47
980155498cai 发表于 2016-12-20 15:52
Lora 发表于 2016-12-20 13:211 v4 c# K- z$ E6 ?0 o7 A6 o
试了也不行

, v' }6 N' a7 s8 \啊，不会吧
) p* l2 V6 g6 r' A8 D& n
Lora 发表于 2016-12-20 13:21
980155498cai 发表于 2016-12-19 18:26
3 @( |4 G  `5 x* e" T网标导出之前有一个选项你勾选一下，在setup下的ignore Electrical constraints勾选就好了
/ l  z5 o" e, l+ }7 M6 r0 T. p4 {. I
试了也不行
, ?5 A, d  E2 q* C  u2 n+ X+ l

点评

980155498cai
啊，不会吧  详情 回复 发表于 2016-12-20 15:52
980155498cai 发表于 2016-12-19 18:26
网标导出之前有一个选项你勾选一下，在setup下的ignore Electrical constraints勾选就好了

点评

Lora
试了也不行  详情 回复 发表于 2016-12-20 13:21
Lora 发表于 2016-12-19 17:10
yangjinxing521 发表于 2016-12-19 17:04
  d7 ?. D# ~  r4 x7 h' e- e重改一下。。。

  f; m5 p" f5 m, k* [5 ^3 k有好多呢，改的好累呀
* ~/ ^/ d* [* B0 L8 K) h' b
yangjinxing521 发表于 2016-12-19 17:04
重改一下。。。

点评

Lora
有好多呢，改的好累呀  详情 回复 发表于 2016-12-19 17:10
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