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VIA不要入內層 有花孔

查看数: 278 | 评论数: 9 | 收藏 0
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carol8688
发布时间: 2015-9-17 14:00

正文摘要:

如此NET 為GND 故意要此VIA不要入內層有花孔,不知要如何設定

回复

carol8688 发表于 2015-9-22 12:00
65770096 发表于 2015-9-22 10:35
3 J9 l% x& T) Q) ~; [如图设置

/ H% m4 C5 d+ _3 }' V謝謝 好方法3 a. v$ c  e2 I) U5 ^
65770096 发表于 2015-9-22 10:35
如图设置3 W- p+ [. L. e, A8 j! X

QQ图片20150922103604.png (20.21 KB, 下载次数: 0)

QQ图片20150922103604.png

点评

carol8688
謝謝 好方法  详情 回复 发表于 2015-9-22 12:00
carol8688 发表于 2015-9-18 10:53
dzkcool 发表于 2015-9-17 18:10
7 A7 O* a% e$ D; h+ L如果是单独的几个过孔需要隔离，用Void手工挖开就是了，不要随便去改焊盘参数。

9 Z& E1 Z* _7 t  h謝謝 了解 用Void手工挖开 / A6 C" s; @; g1 @+ Y" v, _. z
q270350800 发表于 2015-9-17 21:46
不是很明白楼主要表达的 意思  楼主是说VIA是全连接  还是十字架；连接    如果要单独几个孔  有很多种方法实现
dzkcool 发表于 2015-9-17 18:10
如果是单独的几个过孔需要隔离，用Void手工挖开就是了，不要随便去改焊盘参数。

点评

carol8688
謝謝 了解 用Void手工挖开  详情 回复 发表于 2015-9-18 10:53
carol8688 发表于 2015-9-17 17:56
要隔離  
kinglangji 发表于 2015-9-17 16:06
不要花焊盘是要全连接么....
carol8688 发表于 2015-9-17 14:19
謝謝
dzkcool 发表于 2015-9-17 14:12
via焊盘参数中有Flash Symbol，建议去了解一下Allegro的封装库知识：https://www.eda365.com:5280/course/141
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