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System SI进行DDR仿真的问题

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发布时间: 2015-8-19 16:54

正文摘要:

      我在用system SI进行DDR仿真的时候,ibs模型已经S参数都已经加载后,在 check signal connectivity一步,点击后,报错。见附件。 3 G3 m1 c- B7 \' J/ |: |3 m       ...

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guan_zhichao 发表于 2015-8-24 20:13
cousins 发表于 2015-8-20 08:20
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8 b* _& n" z" K( @  y$ v/ k6 ?3 }     谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!
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guan_zhichao 发表于 2015-8-24 20:13
qingdalj 发表于 2015-8-19 17:19
! U% Q; @& y) @; Z  x' q' }首先,仿真路径最好不要有中文,因为有些软件会出错;其次,你的port定义有问题,检查一下你的port

4 G4 [9 R9 M7 `4 m   谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!
cousins 发表于 2015-8-20 08:20
解决方法很简单,11,12,16,17,18这5个port你一定是设置了一模一样的正馈和负馈。删掉4个或者按照自己的需要修改下正馈或负馈就可以了。/ g$ L7 Z. V. {5 Q

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谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!  详情 回复 发表于 2015-8-24 20:13
qingdalj 发表于 2015-8-19 17:19
首先,仿真路径最好不要有中文,因为有些软件会出错;其次,你的port定义有问题,检查一下你的port

点评

谢谢大神,我搞了好几天,终于找到问题在哪里了。添加VRM端口的时候,跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数,只看S11,波形是正常的。就忽略了。 非常感谢大神指点!  详情 回复 发表于 2015-8-24 20:13
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