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allegro sigxplor 不能设置pin delay(16.6)

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发布时间: 2014-9-2 17:41

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wpcgood 发表于 2014-9-15 12:20
回忆着回忆 发表于 2014-9-2 22:41
) i1 b8 U1 i3 t  Q5 V重装,我的很多同事都遇到过这个问题,还有可能是你env的问题
# l7 B  t3 f+ }  c" c
重装软件不能解决,重装系统可以解决,可是重装系统太麻烦了啊
wpcgood 发表于 2014-9-15 12:19
procomm1722 发表于 2014-9-2 22:03) G* h5 v5 j+ Y0 L
Pin delay 並不是在SigXpolar 設置的 , 它應該是在 Capture 的 Part library 裡面來添加或是在 PCB 的 Cons ...
& S8 J! z8 l, Y0 C6 ^- @
我想用这个设置规则!可是设置不了,重装系统会解决,但是想知道有没有其他解决办法
回忆着回忆 发表于 2014-9-2 22:41
重装,我的很多同事都遇到过这个问题,还有可能是你env的问题
kevin890505 发表于 2014-9-2 22:27
一般常用的个别脚  直接在 Constraint Manager中设定  如果一个高速芯片  很多或者全部脚都要考虑 ,就需要导入 pin delay 文件来快速导入,具体的可以执行  file-import- pin delay  然后help一下就可以了    一般来说   pin  delay file可以直接从器件官网下载 最常见的是比如altera的FPGA 一些NB的处理器啊  内存什么的
procomm1722 发表于 2014-9-2 22:03
Pin delay 並不是在SigXpolar 設置的 , 它應該是在 Capture 的 Part library 裡面來添加或是在 PCB 的 Constraint Manager 來設定.6 C6 `0 X5 c$ u9 L$ b; Q4 \( e
SigXpolarer 是看整個 die to die 或Pin to Pin 的長度, 並不會幫你看 Pin delay.
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