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请问各位大侠， FPGA/cpld哪本书适合初学者用 wxc287939659 2010-1-13 13:18 0 717 wxc287939659 2010-1-13 13:18
VerilogHDL硬件描述语言 8人参与 attachment recommend  ...2 someone_sl 2008-6-17 11:45 19 3146 ArthurGXH 2010-1-13 11:08
转载：ultraedit 高亮显示 Verilog - [阅读权限 10] zhqiankun 2010-1-8 11:59 0 33 zhqiankun 2010-1-8 11:59
跪求用virtex-2调试uart代码 lansing5520 2010-1-4 13:43 0 710 lansing5520 2010-1-4 13:43
感叹一个，纯FPGA的设计职位好少啊 5人参与 yonklee 2009-12-5 13:24 1 892 sdwsh 2009-12-31 11:53
悬赏 关于阻塞赋值的疑问 14人参与 - [已解决] Addylee 2009-12-25 23:39 3 1136 zxli36 2009-12-28 12:03
请教：Actel FPGA 暂时不用引脚如何配置成高阻/输入 zxli36 2009-12-25 14:21 0 2387 zxli36 2009-12-25 14:21
请问怎么在QuartusII里面生成一个Nand flash的控制核？ seaedge 2009-12-21 09:57 0 861 seaedge 2009-12-21 09:57
求助：如何用verilog 设计占空比不是50%的周期信号 忆水流年 2009-12-18 11:24 0 808 忆水流年 2009-12-18 11:24
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求数字锁相环原理 幻色精灵 2009-11-30 21:51 2 1032 lihongfei_sky 2009-12-1 15:58
关于亚稳态和同步，请高手讲解，附资料-cypress attachment zxli36 2009-11-25 11:36 0 965 zxli36 2009-11-25 11:36
FPGA_CPLD数字电路设计经验分享.pdf attachment 草鞋0923 2009-10-23 15:55 1 902 haiqichen 2009-11-20 15:19
下面的IO端口信息是什么含义？ lwenming 2009-11-18 17:23 0 823 lwenming 2009-11-18 17:23
求数字钟VHDL源代码一份......急！！ 心飞身随 2009-11-9 20:13 1 1397 lihongfei_sky 2009-11-18 17:22
求助，电子时钟设计 STlife 2009-11-16 14:59 0 842 STlife 2009-11-16 14:59
FPGA内的内容如何读出来？ IO357 2009-10-5 02:28 5 1355 szkalwa 2009-11-13 13:06
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modelsim库不能用 sghgfmu 2009-11-6 11:24 0 792 sghgfmu 2009-11-6 11:24
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