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差分线等长重要还是等距重要

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发表于 2015-10-26 09:53 | 只看该作者回帖奖励

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如题，差分线等长重要还是等距重要啊，要打过孔的差分线怎么走

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发表于 2015-10-26 10:56 | 只看该作者

具体情况具体分析，同场合的需求是不一样的，根本没有什么必然关系，一切要按指标来。以太网是串行接口，最大传输距离100m，5类线的每对间的最大延迟误差指标是50ns@100m，PCB走线长度那一点点差异相对于线缆简直就是毛毛雨，设计上更注重阻抗匹配，降低损耗，等间距重要。 DDR内存就不一样了，因为是并行接口，数据位要求和时钟严格同步，而传输距离并不长，所以等长比差分更重要。过孔越少越好。

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打完过孔肯定会发生不匹配，其实要求没有那么严格，想要严格做阻抗控制你可以做仿真详情回复发表于 2015-10-26 21:55

打了过孔感觉就不等距了，怎么办详情回复发表于 2015-10-26 13:08

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3^#

发表于 2015-10-26 11:00 | 只看该作者

这个问题其实本身就是个错误，一定是经验主义，等长是为了等相位，而不至于差分作用体现不出来；等距是为了阻抗不变化，保持阻抗的一致性；via的话就对称打就好啦。

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谢谢，打过孔距离就变化了阻抗就不匹配了啊详情回复发表于 2015-10-26 13:10

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楼主| 发表于 2015-10-26 13:08 | 只看该作者

12345liyunyun 发表于 2015-10-26 10:56% t2 e. j# N0 G6 o6 |9 R9 W9 I
具体情况具体分析，同场合的需求是不一样的，根本没有什么必然关系，一切要按指标来。以太网是串行接口， ...

打了过孔感觉就不等距了，怎么办

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楼主| 发表于 2015-10-26 13:10 | 只看该作者

菩提老树发表于 2015-10-26 11:008 h: Z6 j% d6 |- O+ U/ r* m# r: j
这个问题其实本身就是个错误，一定是经验主义，等长是为了等相位，而不至于差分作用体现不出来；等距是为了 ...

谢谢，打过孔距离就变化了阻抗就不匹配了啊

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这个是必然的，所以说via需要做阻抗处理。详情回复发表于 2015-10-26 14:29

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发表于 2015-10-26 14:29 | 只看该作者

fanchenydj 发表于 2015-10-26 13:103 G5 }* ]; `. m; R1 @
谢谢，打过孔距离就变化了阻抗就不匹配了啊

这个是必然的，所以说via需要做阻抗处理。

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via 要怎么做阻抗处理啊详情回复发表于 2015-10-26 16:58

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楼主| 发表于 2015-10-26 16:58 | 只看该作者

菩提老树发表于 2015-10-26 14:29, N! g5 O) g+ O% m; e# Q3 d
这个是必然的，所以说via需要做阻抗处理。

via 要怎么做阻抗处理啊

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这个需要你做一些via的仿真或者是测试才能确定。比如用多大drill，多大的pad，多大的anti-pad等等详情回复发表于 2015-10-26 17:03

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发表于 2015-10-26 17:03 | 只看该作者

fanchenydj 发表于 2015-10-26 16:58
: G9 F/ ]0 o. K B& rvia 要怎么做阻抗处理啊

这个需要你做一些via的仿真或者是测试才能确定。比如用多大drill，多大的pad，多大的anti-pad等等

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发表于 2015-10-26 21:55 | 只看该作者

12345liyunyun 发表于 2015-10-26 10:56- D8 u5 Y' G, ^9 Q) f
具体情况具体分析，同场合的需求是不一样的，根本没有什么必然关系，一切要按指标来。以太网是串行接口， ...

打完过孔肯定会发生不匹配，其实要求没有那么严格，想要严格做阻抗控制你可以做仿真

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谢谢详情回复发表于 2015-10-27 08:35

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楼主| 发表于 2015-10-27 08:35 | 只看该作者

12345liyunyun 发表于 2015-10-26 21:55$ B9 r) ?7 s. ]! R$ k$ Q
打完过孔肯定会发生不匹配，其实要求没有那么严格，想要严格做阻抗控制你可以做仿真

谢谢

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发表于 2015-11-3 18:45 | 只看该作者

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