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如何确定信号线需要做等长处理以及其长度的公差?

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发表于 2015-3-19 08:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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在PCB设计中,经常遇到要做等长处理,对于常见电路如DDR3等就直接进行了等长处理,可有时候遇到的网络不常见,不知道需不需要做等长,如果需要又是如何来确定这个等长误差,这个问题一直困扰着我,有没有大师能给解释一下?3 y6 [3 Y6 c3 m9 @$ I. o4 U
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发表于 2015-3-19 10:09 | 只看该作者
如果我说仿真可以决定你要不要等长你一定不信。
# z( ?2 R: J! t& c: L% a* i, A/ b) a% m2 p! j3 U6 T
等长的目的主要是为了满足时序。调整线宽的目的主要是为了高低电平寄存有效的time以及可靠的单调性。
6 t+ I. i3 p9 v/ Z所以准确的模型可以用来确定你是否一定要做等长。( j1 Y4 F% t$ O% l4 P6 V
至少我所了解的很多项目中,等长的DDR性能未必是最好的。一定是有某些走线长一些,有些走线短一点可以满足最佳的时序或者最佳的眼图。
新年伊始,稳中求胜

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发表于 2015-3-19 10:16 | 只看该作者
我相信cousins。
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