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2017年11月14日QA检查报告节选

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发表于 2017-11-15 09:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.等长未处理: K" t3 w8 [) \7 S2 |5 f& F2 H7 x) a
# p0 h% v& E0 Q/ P# i
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发表于 2017-12-20 16:43 | 只看该作者
EDA365QA 发表于 2017-11-15 09:53" H6 R$ w3 F/ B7 L2 f/ h. t$ y
5.LED极性反了
1 n4 I! y7 I# N" a
做的封装画的二极管的正负极和封封装上标的正极自相矛盾。
% A- I) s9 m$ b; p2 I- n" y9 J; x

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 楼主| 发表于 2017-11-15 09:52 | 只看该作者
3.隔离焊盘太大导致高速差分走线没有完整参考平面! x0 _. H! r% N. v
+ e! B7 A, |# x

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 楼主| 发表于 2017-11-15 09:59 | 只看该作者
本帖最后由 EDA365QA 于 2017-11-16 09:01 编辑 # x& ]  }4 _( O9 X3 l! B

# z* l/ l  h6 w1 I11.耳机线走8-10mil已经足够了,不要铺铜。
; L/ n. g0 J3 U: M9 s$ T1 O+ o
8 S  g9 H* F( D

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 楼主| 发表于 2017-11-15 09:51 | 只看该作者
2.CLK没有按照规范等长
! j+ C6 _: l( v2 `6 y+ p/ T- c  `/ ]1 f2 _ : `4 D$ M- w, f

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 楼主| 发表于 2017-11-15 09:53 | 只看该作者
4.原理要求需要过大电流,加宽走线2 w( E& c  M* X8 s8 a
" X9 I& o( O' x: @+ G

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 楼主| 发表于 2017-11-15 09:53 | 只看该作者
5.LED极性反了
7 z$ h8 l. B" ^
' E0 i4 A* H$ s! F

点评

做的封装画的二极管的正负极和封封装上标的正极自相矛盾。  详情 回复 发表于 2017-12-20 16:43

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 楼主| 发表于 2017-11-15 09:54 | 只看该作者
6.48V没做安规
; n2 X4 T; v, q; a! W2 F6 T# B
: K& v, m, o& y6 o( }4 k( }

点评

谁能普及一下安规是什么  详情 回复 发表于 2017-11-15 10:06

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 楼主| 发表于 2017-11-15 09:57 | 只看该作者
7.铜皮挖空大,距离板边15-20mil左右即可。
& A& F  E6 l) X7 c- M 4 C4 F5 O. u# N: V6 K1 p" U

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 楼主| 发表于 2017-11-15 09:57 | 只看该作者
8.高低压做一下隔离处理9 n4 {2 A' I" Y9 D3 N" s
6 S7 G  C/ c' `

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 楼主| 发表于 2017-11-15 09:58 | 只看该作者
9.隔离器件中间挖空处理
6 s; X! N% j- _) ?# F $ C8 h2 `2 C* }5 |! F

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 楼主| 发表于 2017-11-15 09:58 | 只看该作者
10.CAN部分走差分
- c& A( e/ ~$ }+ Z
2 R# V% p, t2 f8 F6 d! K

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 楼主| 发表于 2017-11-15 09:59 | 只看该作者
12.尺寸标注有误差
5 b& h: l3 C8 [5 Y8 h  s4 I+ {7 x
4 o3 u4 f8 L3 `& W4 o/ B  B, I

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发表于 2017-11-15 10:06 | 只看该作者
EDA365QA 发表于 2017-11-15 09:54
& O8 i% Z3 T; P6.48V没做安规
. I8 T8 Q; `, [  @
谁能普及一下安规是什么7 r* \0 ]: B+ w

; \0 k; {  ^" H4 v

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发表于 2017-11-15 21:25 | 只看该作者
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发表于 2017-11-17 00:09 | 只看该作者
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