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PLL 锁相环功能?

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发表于 2017-11-8 16:54 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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   时不时碰到PLL锁相环这个概念,有没有大大详细说明下这个锁相环是干什么用的?谢谢!
* a- l& F& i' @9 {. y$ T   参考百度百科https://baike.baidu.com/item/PLL/3852?fr=aladdin.
3 P, Y- O; \% z   一般时钟信号的频率不是很高,当需要高频时序信号时,通过PLL提高时钟频率,生成高频时序信号?4 D# \7 X) c, G6 W$ J
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发表于 2017-11-10 23:48 | 只看该作者
PLL(Phase Locked Loop): 为锁相回路或锁相环,用来统一整合时脉讯号,使高频器件正常工作,如内存的存取资料等。PLL用于振荡器中的反馈技术。 许多电子设备要正常工作,通常需要外部的输入信号与内部的振荡信号同步。一般的晶振由于工艺与成本原因,做不到很高的频率,而在需要高频应用时,有相应的器件VCO,实现转成高频,但并不稳定,故利用锁相环路就可以实现稳定且高频的时脉冲讯号。百度的资料,后续详细解释下。

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发表于 2017-11-9 17:30 | 只看该作者
最主要作用就是超频(分频和倍频)
% S) ^+ W5 L& X常见的单片机比如STM32,MSP430内部时钟电路部分都有PLL
* W: @$ Z. V6 F至于其基本结构、工作原理等资料网上就很多了' U: Z9 g# W7 h/ Q
https://ezchina.analog.com/message/18945#comment-18946
( n+ W# p3 d5 d9 t! n# \ design-debug-a-pll-circuit_cn.pdf (418.38 KB, 下载次数: 18)
. o) H0 D1 j* a& N0 g; l8 X; a, |; d8 k5 m* v3 t
9 K! A1 D2 Z) N5 v* ?
1 ]4 \" u7 C9 t8 ^/ `0 W/ T

9 @2 `9 `5 }/ Z+ [) p' I* n1 f; u! }) G4 ^- ~& Z( ~* d

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3 f3 a% S3 P7 p( F9 k  U

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发表于 2017-11-13 09:07 | 只看该作者
1. 你电路时钟哪里来的?除低频用晶振,高频很多事PLL实现的 2. 发射机的载波,也是需要PLL实现,比如你需要一个800MHZ正弦波 3.PLL好处是可以产生多个信道频率信号,能快速切换

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发表于 2017-11-13 16:11 | 只看该作者
路过就进来看看。

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发表于 2017-11-25 19:17 | 只看该作者
K了我一个月的站,刚才site的时候
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